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74HC10PW	文件：34.29 Kbytes Page：5 Pages	Triple 3-input NAND gate GENERAL DESCRIPTION The 74HC/HCT10 are high-speed Si-gate CMOS devices and are pin compatible with low power Schottky TTL (LSTTL). They are specified in compliance with JEDEC standard no. 7A. The 74HC/HCT10 provide the 3-input NAND function. FEATURES • Output capability: standard • ICC categ 文件：34.29 Kbytes 页数：5 Pages	PHI PHI	PHI
74HC10PW	文件：224.64 Kbytes Page：11 Pages	Triple 3-input NAND gate 1. General description The 74HC10; 74HCT10 is a triple 3-input NAND gate. Inputs include clamp diodes that enable the use of current limiting resistors to interface inputs to voltages in excess of VCC. 2. Features and benefits • Complies with JEDEC standard JESD7A • Input levels: • For74HC10 文件：224.64 Kbytes 页数：11 Pages	NEXPERIA 安世	NEXPERIA
74HC10PW-Q100	文件：223.95 Kbytes Page：11 Pages	Triple 3-input NAND gate 1. General description The 74HC10-Q100; 74HCT10-Q100 is a triple 3-input NAND gate. Inputs include clamp diodes. This enables the use of current limiting resistors to interface inputs to voltages in excess of VCC. This product has been qualified to the Automotive Electronics Council (AEC) stand 文件：223.95 Kbytes 页数：11 Pages	NEXPERIA 安世	NEXPERIA
74HC10-Q100	文件：223.95 Kbytes Page：11 Pages	Triple 3-input NAND gate 1. General description The 74HC10-Q100; 74HCT10-Q100 is a triple 3-input NAND gate. Inputs include clamp diodes. This enables the use of current limiting resistors to interface inputs to voltages in excess of VCC. This product has been qualified to the Automotive Electronics Council (AEC) stand 文件：223.95 Kbytes 页数：11 Pages	NEXPERIA 安世	NEXPERIA
74HC107D-Q100	文件：747.99 Kbytes Page：17 Pages	Dual JK flip-flop with reset; negative-edge trigger 文件：747.99 Kbytes 页数：17 Pages	NEXPERIA 安世	NEXPERIA
74HC107PW-Q100	文件：747.99 Kbytes Page：17 Pages	Dual JK flip-flop with reset; negative-edge trigger 文件：747.99 Kbytes 页数：17 Pages	NEXPERIA 安世	NEXPERIA
74HC107-Q100	文件：747.99 Kbytes Page：17 Pages	Dual JK flip-flop with reset; negative-edge trigger 文件：747.99 Kbytes 页数：17 Pages	NEXPERIA 安世	NEXPERIA
74HC109	文件：643.32 Kbytes Page：6 Pages	High Speed CMOS Logic 文件：643.32 Kbytes 页数：6 Pages	SS	SS
74HC109D-Q100	文件：799.3 Kbytes Page：17 Pages	Dual JK flip-flop with set and reset; positive-edge-trigger 文件：799.3 Kbytes 页数：17 Pages	NEXPERIA 安世	NEXPERIA
74HC109-Q100	文件：799.3 Kbytes Page：17 Pages	Dual JK flip-flop with set and reset; positive-edge-trigger 文件：799.3 Kbytes 页数：17 Pages	NEXPERIA 安世	NEXPERIA

技术参数

VCC (V)：
2.0 - 6.0
Logic switching levels：
CMOS
Output drive capability (mA)：
± 5.2
tpd (ns)：
16
fmax (MHz)：
78
Power dissipation considerations：
low
Tamb (°C)：
-40~125
Rth(j-a) (K/W)：
87
Ψth(j-top) (K/W)：
6.5
Rth(j-c) (K/W)：
45
Package name：
SO14

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