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MC10E151	文件：104.16 Kbytes Page：4 Pages	6-BIT D REGISTER Description The MC10E/100E151 contains 6 D-type, edge-triggered, master-slave flip-flops with differential outputs. Data enters the master when both CLK1 and CLK2 are LOW, and is transferred to the slave when CLK1 or CLK2 (or both) go HIGH. The asynchronous Master Reset (MR) makes all Q outputs g 文件：104.16 Kbytes 页数：4 Pages	ONSEMI 安森美半导体	ONSEMI
MC10E151	文件：127.84 Kbytes Page：8 Pages	5V ECL 6-Bit D Register 文件：127.84 Kbytes 页数：8 Pages	ONSEMI 安森美半导体	ONSEMI
MC10E151	文件：155.48 Kbytes Page：7 Pages	5V ECL 6?륛it D Register 文件：155.48 Kbytes 页数：7 Pages	ONSEMI 安森美半导体	ONSEMI
MC10E151	文件：300 bytes Page：1 Pages	MC10E151: ECL 6-Bit D Register The MC10E/100E151 contains 6 D-type, edge-triggered, master-slave flip-flops with differential outputs. Data enters the master when both CLK1 and CLK2 are LOW, and is transferred to the slave when CLK1 or CLK2 (or both) go HIGH. The asynchronous Master Reset (MR) makes all Q outputs go LOW.The 100 S 1100MHz Min. Toggle Frequency\nDifferential Outputs\nAsynchronous Master Reset\nDualClocks\nPECL Mode Operating Range: VCC = 4.2 V to 5.7 V with VEE = 0 V\nNECL Mode Operating Range: VCC = 0 V with VEE = -4.2 V to -5.7 V\nInternal Input Pulldown Resistors\nESD Protection: > 2 kV HBM, > 200 V MM\nMee;	ONSEMI 安森美半导体	ONSEMI
MC10E151_06	文件：127.84 Kbytes Page：8 Pages	5V ECL 6-Bit D Register 文件：127.84 Kbytes 页数：8 Pages	ONSEMI 安森美半导体	ONSEMI
MC10E151_16	文件：155.48 Kbytes Page：7 Pages	5V ECL 6?륛it D Register 文件：155.48 Kbytes 页数：7 Pages	ONSEMI 安森美半导体	ONSEMI
MC10E151FN	文件：127.84 Kbytes Page：8 Pages	5V ECL 6-Bit D Register 文件：127.84 Kbytes 页数：8 Pages	ONSEMI 安森美半导体	ONSEMI
MC10E151FNG	文件：155.48 Kbytes Page：7 Pages	5V ECL 6?륛it D Register 文件：155.48 Kbytes 页数：7 Pages	ONSEMI 安森美半导体	ONSEMI
MC10E151FNG	文件：127.84 Kbytes Page：8 Pages	5V ECL 6-Bit D Register 文件：127.84 Kbytes 页数：8 Pages	ONSEMI 安森美半导体	ONSEMI
MC10E151FNR2	文件：127.84 Kbytes Page：8 Pages	5V ECL 6-Bit D Register 文件：127.84 Kbytes 页数：8 Pages	ONSEMI 安森美半导体	ONSEMI

技术参数

Compliance：
Pb-freeHalide free
Status：
Active
Description：
ECL 6-Bit D Register
Type：
Register
Bits：
6
Input Level：
ECL
Output Level：
ECL
VCC Typ (V)：
5
tJitter Typ (ps)：
1
tpd Typ (ns)：
0.65
tsu Min (ns)：
0
th Min (ns)：
0.35
trec Typ (ns)：
0.55
tR & tF Max (ps)：
700
fToggle Typ (MHz)：
1100
Package Type：
PLCC-28

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