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HEF4031B	文件：76.29 Kbytes Page：7 Pages	64-stage static shift register DESCRIPTION The HEF4031B is an edge-triggered 64-stage static shift register with two serial data inputs (DA, DB), a data select input A/B, a clock input (CP), a buffered clock output (CO), and buffered outputs from the 64th bit position (O63, O63). The output O63 is capable of driving one TTL lo 文件：76.29 Kbytes 页数：7 Pages	PHI 飞利浦	PHI
HEF4031BD	文件：76.29 Kbytes Page：7 Pages	64-stage static shift register DESCRIPTION The HEF4031B is an edge-triggered 64-stage static shift register with two serial data inputs (DA, DB), a data select input A/B, a clock input (CP), a buffered clock output (CO), and buffered outputs from the 64th bit position (O63, O63). The output O63 is capable of driving one TTL lo 文件：76.29 Kbytes 页数：7 Pages	PHI 飞利浦	PHI
HEF4031BF	文件：76.29 Kbytes Page：7 Pages	64-stage static shift register DESCRIPTION The HEF4031B is an edge-triggered 64-stage static shift register with two serial data inputs (DA, DB), a data select input A/B, a clock input (CP), a buffered clock output (CO), and buffered outputs from the 64th bit position (O63, O63). The output O63 is capable of driving one TTL lo 文件：76.29 Kbytes 页数：7 Pages	PHI 飞利浦	PHI
HEF4031BN	文件：76.29 Kbytes Page：7 Pages	64-stage static shift register DESCRIPTION The HEF4031B is an edge-triggered 64-stage static shift register with two serial data inputs (DA, DB), a data select input A/B, a clock input (CP), a buffered clock output (CO), and buffered outputs from the 64th bit position (O63, O63). The output O63 is capable of driving one TTL lo 文件：76.29 Kbytes 页数：7 Pages	PHI 飞利浦	PHI
HEF4031BP	文件：76.29 Kbytes Page：7 Pages	64-stage static shift register DESCRIPTION The HEF4031B is an edge-triggered 64-stage static shift register with two serial data inputs (DA, DB), a data select input A/B, a clock input (CP), a buffered clock output (CO), and buffered outputs from the 64th bit position (O63, O63). The output O63 is capable of driving one TTL lo 文件：76.29 Kbytes 页数：7 Pages	PHI 飞利浦	PHI
HEF4031BT	文件：76.29 Kbytes Page：7 Pages	64-stage static shift register DESCRIPTION The HEF4031B is an edge-triggered 64-stage static shift register with two serial data inputs (DA, DB), a data select input A/B, a clock input (CP), a buffered clock output (CO), and buffered outputs from the 64th bit position (O63, O63). The output O63 is capable of driving one TTL lo 文件：76.29 Kbytes 页数：7 Pages	PHI 飞利浦	PHI
HEF4031BD	文件：300 bytes Page：1 Pages	64-stage static shift register	恩XP	恩XP

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