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8745BYI	文件：880.85 Kbytes Page：21 Pages	丝印：ICS8745BYI；Package：LQFP；1:5 Differential-to-LVDS Zero Delay Clock Generator Features • Five differential LVDS outputs designed to meet or exceed the requirements of ANSI TIA/EIA-644 • Selectable differential clock inputs • CLKx, nCLKx pairs can accept the following differential input levels: LVPECL, LVDS, LVHSTL, HCSL, SSTL • Output frequency range: 31.25MHz to 700M 文件：880.85 Kbytes 页数：21 Pages	RENESAS 瑞萨	RENESAS
8745BYILF	文件：880.85 Kbytes Page：21 Pages	丝印：ICS8745BYILF；Package：LQFP；1:5 Differential-to-LVDS Zero Delay Clock Generator Features • Five differential LVDS outputs designed to meet or exceed the requirements of ANSI TIA/EIA-644 • Selectable differential clock inputs • CLKx, nCLKx pairs can accept the following differential input levels: LVPECL, LVDS, LVHSTL, HCSL, SSTL • Output frequency range: 31.25MHz to 700M 文件：880.85 Kbytes 页数：21 Pages	RENESAS 瑞萨	RENESAS
8745BYILFT	文件：880.85 Kbytes Page：21 Pages	丝印：ICS8745BYILF；Package：LQFP；1:5 Differential-to-LVDS Zero Delay Clock Generator Features • Five differential LVDS outputs designed to meet or exceed the requirements of ANSI TIA/EIA-644 • Selectable differential clock inputs • CLKx, nCLKx pairs can accept the following differential input levels: LVPECL, LVDS, LVHSTL, HCSL, SSTL • Output frequency range: 31.25MHz to 700M 文件：880.85 Kbytes 页数：21 Pages	RENESAS 瑞萨	RENESAS
8745BYIT	文件：880.85 Kbytes Page：21 Pages	丝印：ICS8745BYI；Package：LQFP；1:5 Differential-to-LVDS Zero Delay Clock Generator Features • Five differential LVDS outputs designed to meet or exceed the requirements of ANSI TIA/EIA-644 • Selectable differential clock inputs • CLKx, nCLKx pairs can accept the following differential input levels: LVPECL, LVDS, LVHSTL, HCSL, SSTL • Output frequency range: 31.25MHz to 700M 文件：880.85 Kbytes 页数：21 Pages	RENESAS 瑞萨	RENESAS
8745BYI	文件：814.38 Kbytes Page：20 Pages	1:5 Differential-to-LVDS Zero Delay Clock Generator 文件：814.38 Kbytes 页数：20 Pages	IDT	IDT
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8745BYILFT	文件：300 bytes Page：1 Pages	IC CLK GEN 1:5 DIFF-LVDS 32-LQFP	Renesas 瑞萨	Renesas
8745BYLF	文件：300 bytes Page：1 Pages	IC CLK GEN 5LVDS 32-LQFP	Renesas 瑞萨	Renesas

技术参数

PLL：
带旁路
输入：
HCSL，LVDS，LVHSTL，LVPECL，SSTL
输出：
LVDS
电路数：
1
比率 - 输入：
输出
差分 - 输入：
输出
频率 - 最大值：
700MHz
分频器/倍频器：
是/是
电压 - 电源：
3.135 V ~ 3.465 V
工作温度：
-40°C ~ 85°C
安装类型：
表面贴装
封装/外壳：
32-LQFP
供应商器件封装：
32-LQFP（7x7）

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