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74HC112PW-Q100	文件：300 bytes Page：1 Pages	Dual JK flip-flop with set and reset; negative-edge trigger The 74HC112-Q100; 74HCT112-Q100 is a dual negative-edge triggered JK flip-flop. It features individual J and K inputs, clock (nCP) set (nSD) and reset (nRD) inputs. It also has complementary nQ and nQ outputs. The set and reset are asynchronous active LOW inputs and operate independently of the cloc	Nexperia 安世	Nexperia
74HC123BQ	文件：0 bytes Page：0 Pages	NEXPERIA 原厂	NEXPERIANexperia B.V. All rights reserved 安世安世半导体(中国)有限公司上传：深圳市世正电子有限公司	NEXPERIA
74HC125PW,118	文件：0 bytes Page：0 Pages	NEXPERIA NA	NEXPERIANexperia B.V. All rights reserved 安世安世半导体(中国)有限公司上传：深圳市品优时代科技有限公司	NEXPERIA
74HC132AP	文件：0 bytes Page：0 Pages	TOS DIP-14	TOS 上传：深圳市鸿昌盛电子科技有限公司	TOS
74HC138	文件：0 bytes Page：0 Pages	FM/富满 SOIC-16	FM/富满上传：深圳广友电子有限公司	FM/富满

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更多74HC112PW-Q100供应商更新时间2025-10-7 8:20:00