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5962-9070101MEA	文件：367.45 Kbytes Page：16 Pages	型号：5962-9070101MEA；Package：CDIP；Dual J-K Flip-Flop with Set and Reset Positive-Edge Trigger Features • Asynchronous Set and Reset • Schmitt Trigger Clock Inputs • Typical fMAX = 54MHz at VCC = 5V, CL = 15pF, TA = 25oC • Fanout (Over Temperature Range) - Standard Outputs . . . . . . . . . . . . . . . 10 LSTTL Loads - Bus Driver Outputs . . . . . . . . . . . . . 15 LSTTL Loads • Wi 文件：367.45 Kbytes 页数：16 Pages	德州仪器	ETC
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5962-9070101MEA	文件：367.45 Kbytes Page：16 Pages	型号：5962-9070101MEA；Package：CDIP；Dual J-K Flip-Flop with Set and Reset Positive-Edge Trigger Features • Asynchronous Set and Reset • Schmitt Trigger Clock Inputs • Typical fMAX = 54MHz at VCC = 5V, CL = 15pF, TA = 25oC • Fanout (Over Temperature Range) - Standard Outputs . . . . . . . . . . . . . . . 10 LSTTL Loads - Bus Driver Outputs . . . . . . . . . . . . . 15 LSTTL Loads • Wi 文件：367.45 Kbytes 页数：16 Pages	德州仪器	ETC
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详细参数

型号：
5962-9070101MEA
制造商：
Texas Instruments
功能描述：
Flip Flop JK# -Type Pos-Edge 2-Element 16-Pin CDIP Tube
功能描述：
8415001EA, DUAL J-K POS-EDGE-TRIG F-F

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