LMK04714-Q1 Automotive Grade Ultra-Low-Noise JESD204B/C Dual-Loop Clock Jitter Cleaner

1 Features • AEC-Q100 Grade 1: –40°C to 125°C • Maximum clock output frequency: 3255 MHz • Multi-mode: dual PLL, single PLL, and clock distribution • 6-GHz external VCO or distribution input • Ultra-low noise, at 2500 MHz: – 54-fs RMS jitter (12 kHz to 20 MHz) – 64-fs RMS jitter (100 Hz to

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符合 JESD204B 和 JESD204C 标准的汽车类超低噪声 3.2GHz 双环路时钟抖动清除器

LMK04714-Q1 是一款适用于航天应用、支持 JEDEC JESD204B/C 的高性能时钟调节器。\n\nPLL2 可以配置 14 个时钟输出以驱动 7 个 JESD204B/C 转换器或其他逻辑器件（使用器件和 SYSREF 时钟）。SYSREF 可以通过直流和交流耦合提供。14 个输出中的每一个输出都可以单独配置为用于传统时钟系统的高性能输出（不限于 JESD204B/C 应用）。\n\n无论有无 SYSREF 生成或重新计时，该器件都可以配置为在双 PLL、单 PLL 或时钟分配模式下运行。PLL2 可以使用内部或外部 VCO 工作。\n\n高性能与多种特性（如功耗和性能权衡调节 AEC-Q100 等级 1：–40°C 至 125°C\n \n最高时钟输出频率：3255MHz\n \n多模式：双 PLL、单 PLL 和时钟分配\n \n6GHz 外部 VCO 或分配输入\n \n超低噪声（2500MHz 时）： \n \n54fs RMS 抖动（12kHz 至 20MHz）\n \n64fs RMS 抖动（100Hz 至 20MHz）\n \n–157.6dBc/Hz 本底噪声\n \n\n \n超低噪声（3200MHz 时）： \n \n61fs RMS 抖动（12kHz 至 20MHz）\n \n67fs RMS 抖动（100Hz 至 100MHz）\n \n–15;

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