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HEF4071B	文件：25.17 Kbytes Page：3 Pages	Quadruple 2-input OR gate DESCRIPTION The HEF4071B is a positive logic quadruple 2-input OR gate. The outputs are fully buffered for highest noise immunity and pattern insensitivity of output impedance. 文件：25.17 Kbytes 页数：3 Pages	PHI 飞利浦	PHI
HEF4071B	文件：361 Kbytes Page：11 Pages	Quad 2-input OR gate General description The HEF4071B is a quad 2-input OR gate. The outputs are fully buffered for highest noise immunity and pattern insensitivity to output impedance variations. It operates over a recommended VDDpower supply range of 3 V to 15 V referenced to VSS (usually ground). Unused 文件：361 Kbytes 页数：11 Pages	恩XP	恩XP
HEF4071B	文件：199.36 Kbytes Page：9 Pages	Quad 2-input OR gate 1. General description The HEF4071B is a quad 2-input OR gate. Inputs include clamp diodes. This enables the use of current limiting resistors to interface inputs to voltages in excess of VDD. 2. Features and benefits • Fully static operation • 5 V, 10 V, and 15 V parametric ratings • CMOS l 文件：199.36 Kbytes 页数：9 Pages	NEXPERIANexperia B.V. All rights reserved 安世安世半导体(中国)有限公司	NEXPERIA
HEF4071BD	文件：25.17 Kbytes Page：3 Pages	Quadruple 2-input OR gate DESCRIPTION The HEF4071B is a positive logic quadruple 2-input OR gate. The outputs are fully buffered for highest noise immunity and pattern insensitivity of output impedance. 文件：25.17 Kbytes 页数：3 Pages	PHI 飞利浦	PHI
HEF4071BF	文件：25.17 Kbytes Page：3 Pages	Quadruple 2-input OR gate DESCRIPTION The HEF4071B is a positive logic quadruple 2-input OR gate. The outputs are fully buffered for highest noise immunity and pattern insensitivity of output impedance. 文件：25.17 Kbytes 页数：3 Pages	PHI 飞利浦	PHI
HEF4071BN	文件：25.17 Kbytes Page：3 Pages	Quadruple 2-input OR gate DESCRIPTION The HEF4071B is a positive logic quadruple 2-input OR gate. The outputs are fully buffered for highest noise immunity and pattern insensitivity of output impedance. 文件：25.17 Kbytes 页数：3 Pages	PHI 飞利浦	PHI
HEF4071BP	文件：25.17 Kbytes Page：3 Pages	Quadruple 2-input OR gate DESCRIPTION The HEF4071B is a positive logic quadruple 2-input OR gate. The outputs are fully buffered for highest noise immunity and pattern insensitivity of output impedance. 文件：25.17 Kbytes 页数：3 Pages	PHI 飞利浦	PHI
HEF4071BP	文件：361 Kbytes Page：11 Pages	Quad 2-input OR gate General description The HEF4071B is a quad 2-input OR gate. The outputs are fully buffered for highest noise immunity and pattern insensitivity to output impedance variations. It operates over a recommended VDDpower supply range of 3 V to 15 V referenced to VSS (usually ground). Unused 文件：361 Kbytes 页数：11 Pages	恩XP	恩XP
HEF4071B-Q100	文件：242.22 Kbytes Page：9 Pages	Quad 2-input OR gate 1. General description The HEF4071B-Q100 is a quad 2-input OR gate. Inputs include clamp diodes. This enables the use of current limiting resistors to interface inputs to voltages in excess of VDD. This product has been qualified to the Automotive Electronics Council (AEC) standard Q100 (Grade 文件：242.22 Kbytes 页数：9 Pages	NEXPERIANexperia B.V. All rights reserved 安世安世半导体(中国)有限公司	NEXPERIA
HEF4071BT	文件：199.36 Kbytes Page：9 Pages	Quad 2-input OR gate 1. General description The HEF4071B is a quad 2-input OR gate. Inputs include clamp diodes. This enables the use of current limiting resistors to interface inputs to voltages in excess of VDD. 2. Features and benefits • Fully static operation • 5 V, 10 V, and 15 V parametric ratings • CMOS l 文件：199.36 Kbytes 页数：9 Pages	NEXPERIANexperia B.V. All rights reserved 安世安世半导体(中国)有限公司	NEXPERIA

技术参数

VCC (V)：
3.0 - 15
Logic switching levels：
CMOS
Output drive capability (mA)：
± 2.4
tpd (ns)：
20
fmax (MHz)：
10
Nr of bits：
4
Power dissipation considerations：
medium
Tamb (°C)：
-40~125
Rth(j-a) (K/W)：
106
Ψth(j-top) (K/W)：
18.8
Rth(j-c) (K/W)：
64
Package name：
SO14

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