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HEF40175BD	文件：62.75 Kbytes Page：5 Pages	Quadruple D-type flip-flop DESCRIPTION The HEF40175B is a quadruple edge-triggered D-type flip-flop with four data inputs (D0 to D3), a clock input (CP), an overriding asynchronous master reset input (MR), four buffered outputs (O0 to O3), and four complementary buffered outputs (O0 to O3). Information on D0 to D3 is trans 文件：62.75 Kbytes 页数：5 Pages	PHI 飞利浦	PHI
HEF40175BF	文件：62.75 Kbytes Page：5 Pages	Quadruple D-type flip-flop DESCRIPTION The HEF40175B is a quadruple edge-triggered D-type flip-flop with four data inputs (D0 to D3), a clock input (CP), an overriding asynchronous master reset input (MR), four buffered outputs (O0 to O3), and four complementary buffered outputs (O0 to O3). Information on D0 to D3 is trans 文件：62.75 Kbytes 页数：5 Pages	PHI 飞利浦	PHI
HEF40175BN	文件：62.75 Kbytes Page：5 Pages	Quadruple D-type flip-flop DESCRIPTION The HEF40175B is a quadruple edge-triggered D-type flip-flop with four data inputs (D0 to D3), a clock input (CP), an overriding asynchronous master reset input (MR), four buffered outputs (O0 to O3), and four complementary buffered outputs (O0 to O3). Information on D0 to D3 is trans 文件：62.75 Kbytes 页数：5 Pages	PHI 飞利浦	PHI
HEF40175BP	文件：62.75 Kbytes Page：5 Pages	Quadruple D-type flip-flop DESCRIPTION The HEF40175B is a quadruple edge-triggered D-type flip-flop with four data inputs (D0 to D3), a clock input (CP), an overriding asynchronous master reset input (MR), four buffered outputs (O0 to O3), and four complementary buffered outputs (O0 to O3). Information on D0 to D3 is trans 文件：62.75 Kbytes 页数：5 Pages	PHI 飞利浦	PHI

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