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HD74LS273	文件：98.24 Kbytes Page：7 Pages	Octal D-type Positive-edge-triggered Flip-Flops (with Clear) The HD74LS273, positive-edge-triggered flip-flops utilize LS TTL circuitry to implement D-type flip-flop logic with a direct clear input. Information at the D inputs meeting the setup time requirements is transferred to the Q outputs on the positive-going edge of the clock pulse. When the cl 文件：98.24 Kbytes 页数：7 Pages	RENESAS 瑞萨	RENESAS
HD74LS273FPEL	文件：98.24 Kbytes Page：7 Pages	Octal D-type Positive-edge-triggered Flip-Flops (with Clear) The HD74LS273, positive-edge-triggered flip-flops utilize LS TTL circuitry to implement D-type flip-flop logic with a direct clear input. Information at the D inputs meeting the setup time requirements is transferred to the Q outputs on the positive-going edge of the clock pulse. When the cl 文件：98.24 Kbytes 页数：7 Pages	RENESAS 瑞萨	RENESAS
HD74LS273P	文件：98.24 Kbytes Page：7 Pages	Octal D-type Positive-edge-triggered Flip-Flops (with Clear) The HD74LS273, positive-edge-triggered flip-flops utilize LS TTL circuitry to implement D-type flip-flop logic with a direct clear input. Information at the D inputs meeting the setup time requirements is transferred to the Q outputs on the positive-going edge of the clock pulse. When the cl 文件：98.24 Kbytes 页数：7 Pages	RENESAS 瑞萨	RENESAS
HD74LS273RPEL	文件：98.24 Kbytes Page：7 Pages	Octal D-type Positive-edge-triggered Flip-Flops (with Clear) The HD74LS273, positive-edge-triggered flip-flops utilize LS TTL circuitry to implement D-type flip-flop logic with a direct clear input. Information at the D inputs meeting the setup time requirements is transferred to the Q outputs on the positive-going edge of the clock pulse. When the cl 文件：98.24 Kbytes 页数：7 Pages	RENESAS 瑞萨	RENESAS
HD74LS279	文件：74.58 Kbytes Page：5 Pages	Quadruple S-R Latches Quadruple S-R Latches 文件：74.58 Kbytes 页数：5 Pages	RENESAS 瑞萨	RENESAS
HD74LS279	文件：45.92 Kbytes Page：5 Pages	Quadruple S-R Latches Quadruple S-R Latches 文件：45.92 Kbytes 页数：5 Pages	HITACHIHitachi Semiconductor 日立日立公司	HITACHI
HD74LS279FPEL	文件：74.58 Kbytes Page：5 Pages	Quadruple S-R Latches Quadruple S-R Latches 文件：74.58 Kbytes 页数：5 Pages	RENESAS 瑞萨	RENESAS
HD74LS279P	文件：74.58 Kbytes Page：5 Pages	Quadruple S-R Latches Quadruple S-R Latches 文件：74.58 Kbytes 页数：5 Pages	RENESAS 瑞萨	RENESAS
HD74LS27FPEL	文件：56.27 Kbytes Page：5 Pages	Triple 3-input Positive NOR Gates Triple 3-input Positive NOR Gates 文件：56.27 Kbytes 页数：5 Pages	RENESAS 瑞萨	RENESAS
HD74LS27P	文件：56.27 Kbytes Page：5 Pages	Triple 3-input Positive NOR Gates Triple 3-input Positive NOR Gates 文件：56.27 Kbytes 页数：5 Pages	RENESAS 瑞萨	RENESAS

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技术参数

Family.：
HD74LS Series
Function Gr1：
Gate
Function Gr2：
NAND Gate
Function：
Quad. 2-input NAND Gates
Number of Channel：
4
Topa[Tjopa] (degC) min.：
-20
Topa[Tjopa] (degC) max.：
75
Vcc (V) min.：
4.75
Vcc (V) max.：
5.25
Iout (mA)：
-0.4/+8
Propagation Delay (ns) max.：
15
Package Type：
SOP
Production Status：
Non-promotion

供应商	型号	品牌	批号	封装	库存	备注	价格
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