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CD74HC297	文件：318.06 Kbytes Page：16 Pages	High-Speed CMOS Logic Digital Phase-Locked Loop Features • Digital Design Avoids Analog Compensation Errors • Easily Cascadable for Higher Order Loops • Useful Frequency Range - K-Clock . . . . . . . . . . . . . . . . . . . . . . . . . .DC to 55MHz (Typ) - I/D-Clock . . . . . . . . . . . . . . . . . . . . DC to 35MHz (Typ) • Dynamically V 文件：318.06 Kbytes 页数：16 Pages	TI 德州仪器	TI
CD74HC297	文件：97.24 Kbytes Page：11 Pages	High-Speed CMOS Logic Digital Phase-Locked-Loop 文件：97.24 Kbytes 页数：11 Pages	TI 德州仪器	TI
CD74HC297	文件：255.96 Kbytes Page：15 Pages	High-Speed CMOS Logic Digital Phase-Locked Loop 文件：255.96 Kbytes 页数：15 Pages	TI 德州仪器	TI
CD74HC297E	文件：318.06 Kbytes Page：16 Pages	丝印：CD74HC297E；Package：PDIP；High-Speed CMOS Logic Digital Phase-Locked Loop Features • Digital Design Avoids Analog Compensation Errors • Easily Cascadable for Higher Order Loops • Useful Frequency Range - K-Clock . . . . . . . . . . . . . . . . . . . . . . . . . .DC to 55MHz (Typ) - I/D-Clock . . . . . . . . . . . . . . . . . . . . DC to 35MHz (Typ) • Dynamically V 文件：318.06 Kbytes 页数：16 Pages	TI 德州仪器	TI
CD74HC297E.A	文件：318.06 Kbytes Page：16 Pages	丝印：CD74HC297E；Package：PDIP；High-Speed CMOS Logic Digital Phase-Locked Loop Features • Digital Design Avoids Analog Compensation Errors • Easily Cascadable for Higher Order Loops • Useful Frequency Range - K-Clock . . . . . . . . . . . . . . . . . . . . . . . . . .DC to 55MHz (Typ) - I/D-Clock . . . . . . . . . . . . . . . . . . . . DC to 35MHz (Typ) • Dynamically V 文件：318.06 Kbytes 页数：16 Pages	TI 德州仪器	TI
CD74HC297	文件：300 bytes Page：1 Pages	高速 CMOS 逻辑数字锁相环 The HC297 and CD74HCT297 are high-speed silicon gate CMOS devices that are pin-compatible with low power Schottky TTL (LSTTL).\n These devices are designed to provide a simple, cost-effective solution to high-accuracy, digital, phase-locked-loop applications. They contain all the necessary circuits • Digital Design Avoids Analog Compensation Errors\n• Useful Frequency Range \n• I/D-Clock...DC to 35MHz (Typ)\n• Very Narrow Bandwidth Attainable\n• Output Capability \n• Bus Driver...I/DOUT\n• Bus Driver Outputs...15 LSTTL Loads\n• Significant Power Reduction Compared to LSTTL Logic ICs\n• High No;	TI 德州仪器	TI
CD74HC297E	文件：251.63 Kbytes Page：15 Pages	High-Speed CMOS Logic Digital Phase-Locked Loop 文件：251.63 Kbytes 页数：15 Pages	TI 德州仪器	TI
CD74HC297E	文件：255.96 Kbytes Page：15 Pages	High-Speed CMOS Logic Digital Phase-Locked Loop 文件：255.96 Kbytes 页数：15 Pages	TI 德州仪器	TI
CD74HC297EE4	文件：251.63 Kbytes Page：15 Pages	High-Speed CMOS Logic Digital Phase-Locked Loop 文件：251.63 Kbytes 页数：15 Pages	TI 德州仪器	TI
CD74HC297E	文件：100 bytes Page：1 Pages	Package：16-DIP（0.300"，7.62mm）；包装：管件类别：集成电路（IC）时钟发生器，PLL，频率合成器描述：IC DIGITAL PLL 16-DIP	TI 德州仪器	TI

技术参数

VCC(Min)(V)：
2
VCC(Max)(V)：
6
Voltage(Nom)(V)：
3.35
Bits(#)：
1
F @ nom voltage(Max)(MHz)：
70
ICC @ nom voltage(Max)(mA)：
0.08
tpd @ nom Voltage(Max)(ns)：
43
IOL(Max)(mA)：
5.2
IOH(Max)(mA)：
-7.8
Operating temperature range(C)：
-55 to 125
Package Group：
PDIP

供应商	型号	品牌	批号	封装	库存	备注	价格
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