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CD74HC297E	文件：318.06 Kbytes Page：16 Pages	型号：CD74HC297E；Package：PDIP；High-Speed CMOS Logic Digital Phase-Locked Loop Features • Digital Design Avoids Analog Compensation Errors • Easily Cascadable for Higher Order Loops • Useful Frequency Range - K-Clock . . . . . . . . . . . . . . . . . . . . . . . . . .DC to 55MHz (Typ) - I/D-Clock . . . . . . . . . . . . . . . . . . . . DC to 35MHz (Typ) • Dynamically V 文件：318.06 Kbytes 页数：16 Pages	TI2 德州仪器	TI2
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CD74HC297E	文件：318.06 Kbytes Page：16 Pages	型号：CD74HC297E；Package：PDIP；High-Speed CMOS Logic Digital Phase-Locked Loop Features • Digital Design Avoids Analog Compensation Errors • Easily Cascadable for Higher Order Loops • Useful Frequency Range - K-Clock . . . . . . . . . . . . . . . . . . . . . . . . . .DC to 55MHz (Typ) - I/D-Clock . . . . . . . . . . . . . . . . . . . . DC to 35MHz (Typ) • Dynamically V 文件：318.06 Kbytes 页数：16 Pages	TI2 德州仪器	TI2
CD74HC297E	文件：318.06 Kbytes Page：16 Pages	型号：CD74HC297E.A；Package：PDIP；High-Speed CMOS Logic Digital Phase-Locked Loop Features • Digital Design Avoids Analog Compensation Errors • Easily Cascadable for Higher Order Loops • Useful Frequency Range - K-Clock . . . . . . . . . . . . . . . . . . . . . . . . . .DC to 55MHz (Typ) - I/D-Clock . . . . . . . . . . . . . . . . . . . . DC to 35MHz (Typ) • Dynamically V 文件：318.06 Kbytes 页数：16 Pages	TI2 德州仪器	TI2
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详细参数

型号：
CD74HC297E
功能描述：
锁相环 - PLL Digital
RoHS：
否
制造商：
Silicon Labs
类型：
PLL Clock Multiplier
电路数量：
1
最大输入频率：
710 MHz
最小输入频率：
0.002 MHz
输出频率范围：
0.002 MHz to 808 MHz
电源电压-最大：
3.63 V
电源电压-最小：
1.71 V
最大工作温度：
+ 85 C
最小工作温度：
- 40 C
封装/箱体：
QFN-36
封装：
Tray

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