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9ZX21901C	文件：513.83 Kbytes Page：21 Pages	19-Output Differential Zbuffer for PCIe Gen2/3 and QPI Features/Benefits • Fixed feedback path/ 0ps input-to-output delay • 9 Selectable SMBus addresses; Multiple devices can share same SMBus segment • 8 dedicated OE# pins; hardware control of outputs • PLL or bypass mode; PLL can dejitter incoming clock • Selectable PLL BW; minimizes jitter pea 文件：513.83 Kbytes 页数：21 Pages	RENESAS 瑞萨	RENESAS
9ZX21901C	文件：180.96 Kbytes Page：16 Pages	19-Output Differential Zbuffer for PCIe Gen2/3 and QPI 文件：180.96 Kbytes 页数：16 Pages	IDT	IDT
9ZX21901C	文件：318.12 Kbytes Page：20 Pages	19-Output Differential Zbuffer for PCIe Gen2/3 and QPI 文件：318.12 Kbytes 页数：20 Pages	IDT	IDT
9ZX21901CKLF	文件：513.83 Kbytes Page：21 Pages	19-Output Differential Zbuffer for PCIe Gen2/3 and QPI Features/Benefits • Fixed feedback path/ 0ps input-to-output delay • 9 Selectable SMBus addresses; Multiple devices can share same SMBus segment • 8 dedicated OE# pins; hardware control of outputs • PLL or bypass mode; PLL can dejitter incoming clock • Selectable PLL BW; minimizes jitter pea 文件：513.83 Kbytes 页数：21 Pages	RENESAS 瑞萨	RENESAS
9ZX21901CKLFT	文件：513.83 Kbytes Page：21 Pages	19-Output Differential Zbuffer for PCIe Gen2/3 and QPI Features/Benefits • Fixed feedback path/ 0ps input-to-output delay • 9 Selectable SMBus addresses; Multiple devices can share same SMBus segment • 8 dedicated OE# pins; hardware control of outputs • PLL or bypass mode; PLL can dejitter incoming clock • Selectable PLL BW; minimizes jitter pea 文件：513.83 Kbytes 页数：21 Pages	RENESAS 瑞萨	RENESAS
9ZX21901C_15	文件：318.12 Kbytes Page：20 Pages	19-Output Differential Zbuffer for PCIe Gen2/3 and QPI 文件：318.12 Kbytes 页数：20 Pages	IDT	IDT
9ZX21901CKLF	文件：180.96 Kbytes Page：16 Pages	19-Output Differential Zbuffer for PCIe Gen2/3 and QPI 文件：180.96 Kbytes 页数：16 Pages	IDT	IDT
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9ZX21901CKLF	文件：180.96 Kbytes Page：16 Pages	19-Output Differential Zbuffer for PCIe Gen2/3 and QPI 文件：180.96 Kbytes 页数：16 Pages	IDT	IDT
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技术参数

Clock Spec.：
DB1900Z v1.6
Diff. Outputs：
19
Diff. Output Signaling：
HCSL
Output Enable (OE) Pins：
8
Output Freq Range (MHz)：
33 - 150
Diff. Inputs：
1
Diff. Input Signaling：
HCSL
Accepts Spread Spec Input：
Yes
Power Consumption Typ (mW)：
1350
Advanced Features：
HW PLL mode control
App Jitter Compliance：
PCIe Gen1
Lead Count (#)：
72
Package Area (mm²)：
100
Chipset Name：
C600
Pkg. Type：
VFQFPN

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