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74ALVCH16646	文件：92.33 Kbytes Page：12 Pages	16-bit bus transceiver/register 3-State DESCRIPTION The 74ALVCH16646 consists of 16 non-inverting bus transceiver circuits with 3-State outputs, D-type flip-flops and control circuitry arranged for multiplexed transmission of data directly from the internal registers. FEATURES • Complies with JEDEC standard no. 8-1A • CMOS low 文件：92.33 Kbytes 页数：12 Pages	PHI PHI	PHI
74ALVCH16646	文件：250.76 Kbytes Page：17 Pages	16-bit bus transceiver/register; 3-state 1. General description The 74ALVCH16646 consists of 16 non-inverting bus transceiver circuits with 3-state outputs, D-type flip-flops and control circuitry arranged for multiplexed transmission of data directly from the internal registers. Data on the ‘A’ or ‘B’ bus will be clocked in the inter 文件：250.76 Kbytes 页数：17 Pages	NEXPERIA 安世	NEXPERIA
74ALVCH16646DGG	文件：250.76 Kbytes Page：17 Pages	16-bit bus transceiver/register; 3-state 1. General description The 74ALVCH16646 consists of 16 non-inverting bus transceiver circuits with 3-state outputs, D-type flip-flops and control circuitry arranged for multiplexed transmission of data directly from the internal registers. Data on the ‘A’ or ‘B’ bus will be clocked in the inter 文件：250.76 Kbytes 页数：17 Pages	NEXPERIA 安世	NEXPERIA
74ALVCH16646DGG	文件：92.33 Kbytes Page：12 Pages	16-bit bus transceiver/register 3-State DESCRIPTION The 74ALVCH16646 consists of 16 non-inverting bus transceiver circuits with 3-State outputs, D-type flip-flops and control circuitry arranged for multiplexed transmission of data directly from the internal registers. FEATURES • Complies with JEDEC standard no. 8-1A • CMOS low 文件：92.33 Kbytes 页数：12 Pages	PHI PHI	PHI
74ALVCH16646DGGRG4	文件：780.12 Kbytes Page：25 Pages	丝印：ALVCH16646；Package：TSSOP；16-BIT BUS TRANSCEIVER AND REGISTER WITH 3-STATE OUTPUTS FEATURES · Member of the Texas Instruments Widebus™ Family · EPIC™ (Enhanced-Performance Implanted CMOS) Submicron Process · ESD Protection Exceeds 2000 V Per MIL-STD-883, Method 3015; Exceeds 200 V Using Machine Model (C = 200 pF, R = 0) · Latch-Up Performance Exceeds 250 mA Per JESD 17 文件：780.12 Kbytes 页数：25 Pages	TI 德州仪器	TI
74ALVCH16646_15	文件：96.65 Kbytes Page：12 Pages	16-bit bus transceiver/register (3-State) 文件：96.65 Kbytes 页数：12 Pages	PHI PHI	PHI
74ALVCH16646DGGRE4	文件：397.91 Kbytes Page：18 Pages	16-BIT BUS TRANSCEIVER AND REGISTER WITH 3-STATE OUTPUTS 文件：397.91 Kbytes 页数：18 Pages	TI 德州仪器	TI
74ALVCH16646DGGRG4	文件：397.91 Kbytes Page：18 Pages	16-BIT BUS TRANSCEIVER AND REGISTER WITH 3-STATE OUTPUTS 文件：397.91 Kbytes 页数：18 Pages	TI 德州仪器	TI
74ALVCH16646DGVRE4	文件：397.91 Kbytes Page：18 Pages	16-BIT BUS TRANSCEIVER AND REGISTER WITH 3-STATE OUTPUTS 文件：397.91 Kbytes 页数：18 Pages	TI 德州仪器	TI
74ALVCH16646DGVRG4	文件：397.91 Kbytes Page：18 Pages	16-BIT BUS TRANSCEIVER AND REGISTER WITH 3-STATE OUTPUTS 文件：397.91 Kbytes 页数：18 Pages	TI 德州仪器	TI

技术参数

VCC(A) (V)：
n.a.
VCC(B) (V)：
n.a.
Logic switching levels：
TTL
Output drive capability (mA)：
± 24
tpd (ns)：
2.6
Nr of bits：
16
fmax (MHz)：
150
Power dissipation considerations：
low
Tamb (°C)：
-40~85
Rth(j-a) (K/W)：
93
Package name：
TSSOP56

供应商	型号	品牌	批号	封装	库存	备注	价格
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更多74ALVCH16646供应商更新时间2026-1-28 16:00:00

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