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74HC73	文件：52.09 Kbytes Page：7 Pages	DualJKflip-flopwithreset;negative-edgetrigger Generaldescription The74HC73isahigh-speedSi-gateCMOSdeviceandispincompatiblewithlow-powerSchottkyTTL(LSTTL).The74HC73isspecifiedincompliancewithJEDECstandardno.7A. Features Low-powerdissipation ComplieswithJEDECstandardno.7A ESDprotection:	PHIPhilips Semiconductors 飞利浦荷兰皇家飞利浦	PHI
74HC73	文件：245.37 Kbytes Page：13 Pages	DualJKflip-flopwithreset;negative-edgetrigger 1.Generaldescription The74HC73isadualnegativeedgetriggeredJKflip-flopwithindividualJ,K,clock(nCP)and reset(nR)inputsandcomplementarynQandnQoutputs.TheJandKinputsmustbestable oneset-uptimepriortotheHIGH-to-LOWclocktransitionforpredictableoperation.(n	NEXPERIANexperia B.V. All rights reserved 安世安世半导体(中国)有限公司	NEXPERIA
74HC73D	文件：245.37 Kbytes Page：13 Pages	DualJKflip-flopwithreset;negative-edgetrigger 1.Generaldescription The74HC73isadualnegativeedgetriggeredJKflip-flopwithindividualJ,K,clock(nCP)and reset(nR)inputsandcomplementarynQandnQoutputs.TheJandKinputsmustbestable oneset-uptimepriortotheHIGH-to-LOWclocktransitionforpredictableoperation.(n	NEXPERIANexperia B.V. All rights reserved 安世安世半导体(中国)有限公司	NEXPERIA
74HC73D	文件：52.09 Kbytes Page：7 Pages	DualJKflip-flopwithreset;negative-edgetrigger Generaldescription The74HC73isahigh-speedSi-gateCMOSdeviceandispincompatiblewithlow-powerSchottkyTTL(LSTTL).The74HC73isspecifiedincompliancewithJEDECstandardno.7A. Features Low-powerdissipation ComplieswithJEDECstandardno.7A ESDprotection:	PHIPhilips Semiconductors 飞利浦荷兰皇家飞利浦	PHI
74HC73DB	文件：52.09 Kbytes Page：7 Pages	DualJKflip-flopwithreset;negative-edgetrigger Generaldescription The74HC73isahigh-speedSi-gateCMOSdeviceandispincompatiblewithlow-powerSchottkyTTL(LSTTL).The74HC73isspecifiedincompliancewithJEDECstandardno.7A. Features Low-powerdissipation ComplieswithJEDECstandardno.7A ESDprotection:	PHIPhilips Semiconductors 飞利浦荷兰皇家飞利浦	PHI
74HC73N	文件：52.09 Kbytes Page：7 Pages	DualJKflip-flopwithreset;negative-edgetrigger Generaldescription The74HC73isahigh-speedSi-gateCMOSdeviceandispincompatiblewithlow-powerSchottkyTTL(LSTTL).The74HC73isspecifiedincompliancewithJEDECstandardno.7A. Features Low-powerdissipation ComplieswithJEDECstandardno.7A ESDprotection:	PHIPhilips Semiconductors 飞利浦荷兰皇家飞利浦	PHI
74HC73PW	文件：245.37 Kbytes Page：13 Pages	DualJKflip-flopwithreset;negative-edgetrigger 1.Generaldescription The74HC73isadualnegativeedgetriggeredJKflip-flopwithindividualJ,K,clock(nCP)and reset(nR)inputsandcomplementarynQandnQoutputs.TheJandKinputsmustbestable oneset-uptimepriortotheHIGH-to-LOWclocktransitionforpredictableoperation.(n	NEXPERIANexperia B.V. All rights reserved 安世安世半导体(中国)有限公司	NEXPERIA
74HC73PW	文件：52.09 Kbytes Page：7 Pages	DualJKflip-flopwithreset;negative-edgetrigger Generaldescription The74HC73isahigh-speedSi-gateCMOSdeviceandispincompatiblewithlow-powerSchottkyTTL(LSTTL).The74HC73isspecifiedincompliancewithJEDECstandardno.7A. Features Low-powerdissipation ComplieswithJEDECstandardno.7A ESDprotection:	PHIPhilips Semiconductors 飞利浦荷兰皇家飞利浦	PHI
CD74HC73	文件：266.53 Kbytes Page：13 Pages	DualJ-KFlip-FlopwithResetNegative-EdgeTrigger	TITexas Instruments 德州仪器美国德州仪器公司	TI
CD74HC73	文件：57.26 Kbytes Page：8 Pages	DualJ-KFlip-FlopwithResetNegative-EdgeTrigger	TITexas Instruments 德州仪器美国德州仪器公司	TI

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