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PLL103-04	文件：122.59 Kbytes Page：4 Pages	1-to-4 Clock Distribution Buffer DESCRIPTIONS The PLL103-04 is a 1-to-4 Clock Distribution Buffer, reproducing the reference input frequency (FIN) at 4 different outputs. It is designed to minimize skew between outputs and provides TTL and CMOS compatible output levels. An output enable selector is available to tri-state all out 文件：122.59 Kbytes 页数：4 Pages	PLL	PLL
PLL103-04	文件：300 bytes Page：1 Pages	1-to-4 Clock Distribution Buffer	PLL	PLL
PLL103-04SC	文件：122.59 Kbytes Page：4 Pages	1-to-4 Clock Distribution Buffer DESCRIPTIONS The PLL103-04 is a 1-to-4 Clock Distribution Buffer, reproducing the reference input frequency (FIN) at 4 different outputs. It is designed to minimize skew between outputs and provides TTL and CMOS compatible output levels. An output enable selector is available to tri-state all out 文件：122.59 Kbytes 页数：4 Pages	PLL	PLL
PLL103-04SI	文件：122.59 Kbytes Page：4 Pages	1-to-4 Clock Distribution Buffer DESCRIPTIONS The PLL103-04 is a 1-to-4 Clock Distribution Buffer, reproducing the reference input frequency (FIN) at 4 different outputs. It is designed to minimize skew between outputs and provides TTL and CMOS compatible output levels. An output enable selector is available to tri-state all out 文件：122.59 Kbytes 页数：4 Pages	PLL	PLL
PLL103-04SM	文件：122.59 Kbytes Page：4 Pages	1-to-4 Clock Distribution Buffer DESCRIPTIONS The PLL103-04 is a 1-to-4 Clock Distribution Buffer, reproducing the reference input frequency (FIN) at 4 different outputs. It is designed to minimize skew between outputs and provides TTL and CMOS compatible output levels. An output enable selector is available to tri-state all out 文件：122.59 Kbytes 页数：4 Pages	PLL	PLL

详细参数

型号：
PLL103-04
制造商：
PLL
制造商全称：
PLL
功能描述：
1-to-4 Clock Distribution Buffer

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