LOW-VOLTAGE 1:10 LVPECL WITH SELECTABLE INPUT CLOCK DRIVER

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Low-Voltage 1:10 LVPECL With Selectable Input Clock Driver

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具有可选输入时钟驱动器的抗辐射 1:10 LVPECL 高速时钟缓冲器

CDCLVP111-SEP 时钟驱动器能够以最低时钟分配偏斜将 LVPECL 输入的一对差分时钟（CLK0 和 CLK1）分配至十对差分 LVPECL 时钟（Q0 和 Q9）输出。CDCLVP111-SEP 可接受两个时钟源传入一个输入多路复用器。CDCLVP111-SEP 专为驱动 50Ω 传输线路而设计。如果不使用某个输出引脚，可将其保持断开，以便降低功耗。如果只使用差分对的其中一个输出引脚，那么另一输出引脚必须同样地端接至 50Ω。\n\n如果要求单端输入运行，VBB基准电压输出被使用。在这种情况下，必须将 VBB 引脚连接至 CLK0 并通过一个 10nF 电容器旁通至 GND。\n\ 供应商项目图 (VID#)：V62/12624-02YE\n \n辐射耐受性： \n \n电离辐射总剂量 (TID)：50krad\n \n单粒子闩锁 (SEL)：43MeV × cm2/mg\n \n\n \n结温范围：-55°C 至 125°C\n \n将一个差分时钟输入对（LVDS、CML、SSTL、LVPECL、LVECL）分配至 10 个差分 LVPECL 或 LVECL 输出\n \n支持宽电源电压范围：2.375V 至 3.8V\n \n通过 CLK_SEL 可选择时钟输入\n \n适用于时钟分配应用的低输出偏斜（典型值为 15ps） \n \n附加抖动小于 1ps\n \n传播;

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具有可选输入时钟驱动器的 1:10 高速时钟缓冲器

CDCLVP111-SP 时钟驱动器能够以最低时钟分配偏移将 LVPECL 输入的一对差分时钟（CLK0 和 CLK1）分配至十对差分 LVPECL 时钟（Q0 和 Q9）输出。CDCLVP111-SP 可接受两个时钟源传入一个输入多路复用器。CDCLVP111-SP 专为驱动 50Ω 传输线路而设计。当一个输出引脚不被使用时，建议将其保持在开状态以减少功耗。如果只使用差分对中的输出引脚中的一个，那么其它输出引脚必须被同样地端接至 50Ω。\n\n如果要求单端输入运行，VBB基准电压输出被使用。在这种情况下，VBB引脚应该被连接至CLK0并由一个 10nF 电容器旁通至接地 (GND)。\n\ • 将一个差分时钟输入对 LVPECL 分配至 10 个差分 LVPECL\n• 支持 2.375V 至 3.8V 的宽电源电压范围\n• 低输出偏移（典型值为 15ps），适用于时钟分配 应用 \n• 传播延迟少于 355ps\n• 兼容低压差分信令 (LVDS)、电流模式逻辑 (CML) 和短截线串联端接逻辑 (SSTL) 输入\n• 针对单端计时的 VBB 基准电压输出\n• 支持国防、航天和医疗 应用 \n• 同一组装和测试场所\n• 支持军用温度范围（-55°C 至 125°C） \n• 延长的产品生命周期\n• 产品可追溯性\n \n \n提供定制温度范围。;

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Package：32-VFQFN 裸露焊盘；包装：卷带（TR）剪切带（CT）Digi-Reel® 得捷定制卷带 类别：集成电路（IC） 时钟缓冲器，驱动器 描述：IC CLK BUFFER 1:10 3.5GHZ 32QFN

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Package：32-VFQFN 裸露焊盘；包装：卷带（TR） 类别：集成电路（IC） 时钟缓冲器，驱动器 描述：IC CLK BUFFER 2:10 3.5GHZ 32QFN

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Package：32-LQFP；包装：卷带（TR） 类别：集成电路（IC） 时钟缓冲器，驱动器 描述：IC CLK BUFFER 2:10 3.5GHZ 32LQFP

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