CDCLVP111-SP Low-Voltage 1:10 LVPECL With Selectable Input Clock Driver

1 Features • Distributes One Differential Clock Input Pair LVPECL to 10 Differential LVPECL • Fully Compatible With LVECL and LVPECL • Supports a Wide Supply Voltage Range From 2.375V to 3.8V • Selectable Clock Input Through CLK_SEL • Low-Output Skew (Typical 15ps) for Clock- Distribution

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CDCLVP111-SEP Low-Voltage 1:10 LVPECL With Selectable Input Clock Driver

1 Features • Vendor item drawing (VID#): V62/12624-02YE • Radiation tolerance: – Total ionizing dose (TID): 50krad – Single-event latch-up (SEL): 43MeV × cm2/mg • Junction temperature range: –55°C to 125°C • Distributes One Differential Clock Input Pair (LVDS, CML, SSTL, LVPECL, LVECL) to 1

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CDCLVP111 Low-Voltage 1:10 LVPECL With Selectable Input Clock Driver

1 Features 1• Distributes One Differential Clock Input Pair LVPECL to 10 Differential LVPECL • Fully Compatible With LVECL and LVPECL • Supports a Wide Supply Voltage Range from 2.375 V to 3.8 V • Selectable Clock Input Through CLK_SEL • Low-Output Skew (Typical 15 ps) for Clock- Distribut

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Low-Voltage 1:10 LVPECL With Selectable Input Clock Driver

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具有可选输入时钟驱动器的 1:10 高速时钟缓冲器

CDCLVP111-SP 时钟驱动器能够以最低时钟分配偏移将 LVPECL 输入的一对差分时钟（CLK0 和 CLK1）分配至十对差分 LVPECL 时钟（Q0 和 Q9）输出。CDCLVP111-SP 可接受两个时钟源传入一个输入多路复用器。CDCLVP111-SP 专为驱动 50Ω 传输线路而设计。当一个输出引脚不被使用时，建议将其保持在开状态以减少功耗。如果只使用差分对中的输出引脚中的一个，那么其它输出引脚必须被同样地端接至 50Ω。\n\n如果要求单端输入运行，VBB基准电压输出被使用。在这种情况下，VBB引脚应该被连接至CLK0并由一个 10nF 电容器旁通至接地 (GND)。\n\ • 将一个差分时钟输入对 LVPECL 分配至 10 个差分 LVPECL\n• 支持 2.375V 至 3.8V 的宽电源电压范围\n• 低输出偏移（典型值为 15ps），适用于时钟分配 应用 \n• 传播延迟少于 355ps\n• 兼容低压差分信令 (LVDS)、电流模式逻辑 (CML) 和短截线串联端接逻辑 (SSTL) 输入\n• 针对单端计时的 VBB 基准电压输出\n• 支持国防、航天和医疗 应用 \n• 同一组装和测试场所\n• 支持军用温度范围（-55°C 至 125°C） \n• 延长的产品生命周期\n• 产品可追溯性\n \n \n提供定制温度范围。;

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