3.3-V PHASE-LOCK LOOP CLOCK DRIVER WITH DIFFERENTIAL LVPECL CLOCK INPUTS

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3.3-V PHASE-LOCK LOOP CLOCK DRIVER

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具有 LVPECL 输出和 LVTTL 输出以及 1/2x、1x 和 2x 频率选项的 3.3V PLL 时钟驱动器

The CDC582 is a high-performance, low-skew, low-jitter clock driver. It uses a phase-lock loop (PLL) to precisely align the frequency and phase of the clock output signals to the differential LVPECL clock (CLKIN, ) input signals. It is specifically designed to operate at speeds from 50 MHz to 100 MH ·Low Output Skew for Clock-Distribution and Clock-GenerationApplications·Operates at 3.3-V VCC·Distributes Differential LVPECL Clock Inputs to 12TTL-Compatible Outputs·Two Select Inputs Configure Up to Nine Outputs to Operate atOne-Half or Double the Input Frequency·No External RC Network Required·S;

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Package：52-TQFP；包装：管件 类别：集成电路（IC） 时钟发生器，PLL，频率合成器 描述：IC 3.3V PLL CLOCK DRIVER 52-TQFP

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Package：52-TQFP；包装：卷带（TR） 类别：集成电路（IC） 时钟发生器，PLL，频率合成器 描述：IC 3.3V PLL CLOCK DRIVER 52-TQFP

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