3.3-V PHASE-LOCK LOOP CLOCK DRIVER WITH 3-STATE OUTPUTS

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3.3-V PHASE-LOCK LOOP CLOCK DRIVER

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具有 1/2x、1x 及 2x 频率选项的 3.3V PLL 时钟驱动器

The CDC2586 is a high-performance, low-skew, low-jitter clock driver. It uses a phase-lock loop (PLL) to precisely align, in both frequency and phase, the clock output signals to the clock input (CLKIN) signal. It is specifically designed for use with popular microprocessors operating at speeds from ·Low Output Skew for Clock-Distribution and Clock-Generation Applications ·Operates at 3.3-V VCC ·Distributes One Clock Input to 12 Outputs ·Two Select Inputs Configure Up to Nine Outputs to Operate at One-Half or Double the Input Frequency ·No External RC Network Required ·External Feedback (FBIN);

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Package：52-TQFP；包装：卷带（TR） 类别：集成电路（IC） 时钟发生器，PLL，频率合成器 描述：IC 3.3V PLL CLK-DRVR 52-TQFP

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