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CD74HCT10M96	文件：1.13946 Mbytes Page：27 Pages	丝印：HCT10M；Package：SOIC；CDx4HCT10 Triple 3-Input NAND Gates 1 Features • LSTTL input logic compatible – VIL(max) = 0.8 V, VIH(min) = 2 V • CMOS input logic compatible – II ≤ 1 μA at VOL, VOH • Buffered inputs • 4.5 V to 5.5 V operation • Wide operating temperature range: -55°C to +125°C • Supports fanout up to 10 LSTTL loads • Significant power r 文件：1.13946 Mbytes 页数：27 Pages	TI 德州仪器	TI
CD74HCT10M96.A	文件：1.13946 Mbytes Page：27 Pages	丝印：HCT10M；Package：SOIC；CDx4HCT10 Triple 3-Input NAND Gates 1 Features • LSTTL input logic compatible – VIL(max) = 0.8 V, VIH(min) = 2 V • CMOS input logic compatible – II ≤ 1 μA at VOL, VOH • Buffered inputs • 4.5 V to 5.5 V operation • Wide operating temperature range: -55°C to +125°C • Supports fanout up to 10 LSTTL loads • Significant power r 文件：1.13946 Mbytes 页数：27 Pages	TI 德州仪器	TI
CD74HCT10M96G4	文件：1.13946 Mbytes Page：27 Pages	丝印：HCT10M；Package：SOIC；CDx4HCT10 Triple 3-Input NAND Gates 1 Features • LSTTL input logic compatible – VIL(max) = 0.8 V, VIH(min) = 2 V • CMOS input logic compatible – II ≤ 1 μA at VOL, VOH • Buffered inputs • 4.5 V to 5.5 V operation • Wide operating temperature range: -55°C to +125°C • Supports fanout up to 10 LSTTL loads • Significant power r 文件：1.13946 Mbytes 页数：27 Pages	TI 德州仪器	TI
CD74HCT10MT	文件：1.13946 Mbytes Page：27 Pages	丝印：HCT10M；Package：SOIC；CDx4HCT10 Triple 3-Input NAND Gates 1 Features • LSTTL input logic compatible – VIL(max) = 0.8 V, VIH(min) = 2 V • CMOS input logic compatible – II ≤ 1 μA at VOL, VOH • Buffered inputs • 4.5 V to 5.5 V operation • Wide operating temperature range: -55°C to +125°C • Supports fanout up to 10 LSTTL loads • Significant power r 文件：1.13946 Mbytes 页数：27 Pages	TI 德州仪器	TI
CD74HCT107	文件：624.14 Kbytes Page：16 Pages	Dual J-K Flip-Flop with Reset Negative-Edge Trigger 文件：624.14 Kbytes 页数：16 Pages	TI 德州仪器	TI
CD74HCT107	文件：451.69 Kbytes Page：15 Pages	Dual J-K Flip-Flop with Reset Negative-Edge Trigger 文件：451.69 Kbytes 页数：15 Pages	TI 德州仪器	TI
CD74HCT107	文件：56.86 Kbytes Page：8 Pages	Dual J-K Flip-Flop with Reset Negative-Edge Trigger 文件：56.86 Kbytes 页数：8 Pages	TI 德州仪器	TI
CD74HCT107E	文件：56.86 Kbytes Page：8 Pages	Dual J-K Flip-Flop with Reset Negative-Edge Trigger 文件：56.86 Kbytes 页数：8 Pages	TI 德州仪器	TI
CD74HCT107E	文件：266.26 Kbytes Page：11 Pages	Dual J-K Flip-Flop with Reset Negative-Edge Trigger 文件：266.26 Kbytes 页数：11 Pages	TI 德州仪器	TI
CD74HCT107E	文件：451.69 Kbytes Page：15 Pages	Dual J-K Flip-Flop with Reset Negative-Edge Trigger 文件：451.69 Kbytes 页数：15 Pages	TI 德州仪器	TI

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技术参数

Supply voltage (Min) (V)：
4.5
Supply voltage (Max) (V)：
5.5
Number of channels (#)：
3
Inputs per channel：
3
IOL (Max) (mA)：
4
IOH (Max) (mA)：
-4
Input type：
TTL-Compatible CMOS
Output type：
Push-Pull
Features：
High speed (tpd 10- 50ns)
Data rate (Max) (Mbps)：
25
Rating：
Catalog

供应商	型号	品牌	批号	封装	库存	备注	价格
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