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AX1255	文件：738.14 Kbytes Page：10 Pages	丝印：AX1255；2A Sink/Source Bus Termination Regulator  GENERAL DE S CRIPTION The AX1255 is a simple, cost-effective and high-speed linear regulator designed to generate termination voltage in double data rate (DDR) memory system to comply with the JEDEC SSTL_2 and SSTL_18 or other specific interfaces such as HSTL, SCSI-2 and SCSI-3 etc. devices req 文件：738.14 Kbytes 页数：10 Pages	AXELITE 亚瑟莱特	AXELITE
AX1255	文件：738.14 Kbytes Page：10 Pages	丝印：AX1255；2A Sink/Source Bus Termination Regulator  GENERAL DE S CRIPTION The AX1255 is a simple, cost-effective and high-speed linear regulator designed to generate termination voltage in double data rate (DDR) memory system to comply with the JEDEC SSTL_2 and SSTL_18 or other specific interfaces such as HSTL, SCSI-2 and SCSI-3 etc. devices req 文件：738.14 Kbytes 页数：10 Pages	AXELITE 亚瑟莱特	AXELITE
AX1255ES	文件：738.14 Kbytes Page：10 Pages	2A Sink/Source Bus Termination Regulator  GENERAL DE S CRIPTION The AX1255 is a simple, cost-effective and high-speed linear regulator designed to generate termination voltage in double data rate (DDR) memory system to comply with the JEDEC SSTL_2 and SSTL_18 or other specific interfaces such as HSTL, SCSI-2 and SCSI-3 etc. devices req 文件：738.14 Kbytes 页数：10 Pages	AXELITE 亚瑟莱特	AXELITE
AX1255ESA	文件：738.14 Kbytes Page：10 Pages	2A Sink/Source Bus Termination Regulator  GENERAL DE S CRIPTION The AX1255 is a simple, cost-effective and high-speed linear regulator designed to generate termination voltage in double data rate (DDR) memory system to comply with the JEDEC SSTL_2 and SSTL_18 or other specific interfaces such as HSTL, SCSI-2 and SCSI-3 etc. devices req 文件：738.14 Kbytes 页数：10 Pages	AXELITE 亚瑟莱特	AXELITE

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