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ICSSSTUAF32868A	文件：686.88 Kbytes Page：22 Pages	28-BITCONFIGURABLEREGISTEREDBUFFERFORDDR2CONFIDENTIAL Features •28-bit1:2registeredbufferwithparitycheckfunctionality •SupportsSSTL_18JEDECspecificationondatainputs andoutputs •SupportsLVCMOSswitchinglevelsonCSGENand RESETinputs •Lowvoltageoperation:VDD=1.7Vto1.9V •Availablein176-ballLFBGApackage	RENESASRenesas Technology Corp 瑞萨瑞萨科技有限公司	RENESAS
ICSSSTUAF32868A	文件：538.99 Kbytes Page：22 Pages	28-BITCONFIGURABLEREGISTEREDBUFFERFORDDR2 Description This28-bit1:2configurableregisteredbufferisdesignedfor1.7Vto1.9VVDDoperation.AllinputsarecompatiblewiththeJEDECstandardforSSTL_18,exceptthechip-selectgate-enable(CSGEN),control(C),andreset(RESET)inputs,whichareLVCMOS.Alloutputsareedge-controlle	IDT Integrated Device Technology, Inc.	IDT
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ICSSSTUAF32868B	文件：737.39 Kbytes Page：23 Pages	28-BITCONFIGURABLEREGISTEREDBUFFERFORDDR2 Features •28-bit1:2registeredbufferwithparitycheckfunctionality •SupportsSSTL_18JEDECspecificationondatainputs andoutputs •SupportsLVCMOSswitchinglevelsonCSGENand RESETinputs •Lowvoltageoperation:VDD=1.7Vto1.9V •Availablein176-ballLFBGApackage	RENESASRenesas Technology Corp 瑞萨瑞萨科技有限公司	RENESAS
ICSSSTUAF32868B	文件：539.18 Kbytes Page：22 Pages	28-BITCONFIGURABLEREGISTEREDBUFFERFORDDR2 Description This28-bit1:2configurableregisteredbufferisdesignedfor1.7Vto1.9VVDDoperation.AllinputsarecompatiblewiththeJEDECstandardforSSTL_18,exceptthechip-selectgate-enable(CSGEN),control(C),andreset(RESET)inputs,whichareLVCMOS.Alloutputsareedge-controlle	IDT Integrated Device Technology, Inc.	IDT
ICSSSTUAF32868BHLF	文件：539.18 Kbytes Page：22 Pages	28-BITCONFIGURABLEREGISTEREDBUFFERFORDDR2 Description This28-bit1:2configurableregisteredbufferisdesignedfor1.7Vto1.9VVDDoperation.AllinputsarecompatiblewiththeJEDECstandardforSSTL_18,exceptthechip-selectgate-enable(CSGEN),control(C),andreset(RESET)inputs,whichareLVCMOS.Alloutputsareedge-controlle	IDT Integrated Device Technology, Inc.	IDT
ICSSSTUAF32868BHLFT	文件：737.39 Kbytes Page：23 Pages	28-BITCONFIGURABLEREGISTEREDBUFFERFORDDR2 Features •28-bit1:2registeredbufferwithparitycheckfunctionality •SupportsSSTL_18JEDECspecificationondatainputs andoutputs •SupportsLVCMOSswitchinglevelsonCSGENand RESETinputs •Lowvoltageoperation:VDD=1.7Vto1.9V •Availablein176-ballLFBGApackage	RENESASRenesas Technology Corp 瑞萨瑞萨科技有限公司	RENESAS
ICSSSTUAH32868A	文件：539.08 Kbytes Page：22 Pages	28-BITCONFIGURABLEREGISTEREDBUFFERFORDDR2 Description This28-bit1:2configurableregisteredbufferisdesignedfor1.7Vto1.9VVDDoperation.AllinputsarecompatiblewiththeJEDECstandardforSSTL_18,exceptthechip-selectgate-enable(CSGEN),control(C),andreset(RESET)inputs,whichareLVCMOS.Alloutputsareedge-controlle	IDT Integrated Device Technology, Inc.	IDT
ICSSSTUAH32868AHLF	文件：539.08 Kbytes Page：22 Pages	28-BITCONFIGURABLEREGISTEREDBUFFERFORDDR2 Description This28-bit1:2configurableregisteredbufferisdesignedfor1.7Vto1.9VVDDoperation.AllinputsarecompatiblewiththeJEDECstandardforSSTL_18,exceptthechip-selectgate-enable(CSGEN),control(C),andreset(RESET)inputs,whichareLVCMOS.Alloutputsareedge-controlle	IDT Integrated Device Technology, Inc.	IDT

详细参数

型号：
SSTUB32868ET/S-T
功能描述：
寄存器 REG BUFFER/PARITY FOR DDR2-800
RoHS：
否
制造商：
NXP Semiconductors
逻辑类型：
CMOS
逻辑系列：
HC
电路数量：
1
最大时钟频率：
36 MHz
高电平输出电流：
- 7.8 mA
低电平输出电流：
7.8 mA
电源电压-最大：
6 V
最大工作温度：
+ 125 C
封装/箱体：
SOT-38
封装：
Tube

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更多SSTUB32868ET/S-T供应商更新时间2025-5-20 13:01:00

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