첨2,첨4,첨8 Clock Generation Chip

Description The MC10/100EL34 is a low skew ÷2, ÷4, ÷8 clock generation chip designed explicitly for low skew clock generation applications. Features • 50 ps Output-to-Output Skew • Synchronous Enable/Disable • Master Reset for Synchronization • PECL Mode Operating Range: VCC = 4.2

文件：94.52 Kbytes 页数：3 Pages

ONSEMI

安森美半导体

5V ECL 첨2, 첨4, 첨8 Clock Generation Chip

Description The MC10/100EL34 is a low skew ÷2, ÷4, ÷8 clock generation chip designed explicitly for low skew clock generation applications. Features • 50 ps Output-to-Output Skew • Synchronous Enable/Disable • Master Reset for Synchronization • PECL Mode Operating Range: VCC = 4.2

文件：69.23 Kbytes 页数：8 Pages

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安森美半导体

5V ECL 첨2, 첨4, 첨8 Clock Generation Chip

文件：133.17 Kbytes 页数：8 Pages

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5V ECL 첨2, 첨4, 첨8 Clock Generation Chip

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安森美半导体

Package：16-SOIC（0.154"，3.90mm 宽）；包装：管件 类别：集成电路（IC） 时钟发生器，PLL，频率合成器 描述：IC CLOCK GEN ECL 2/4/8 16-SOIC

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Package：16-SOIC（0.154"，3.90mm 宽）；包装：管件 类别：集成电路（IC） 时钟发生器，PLL，频率合成器 描述：IC CLOCK GEN ECL 2/4/8 16-SOIC

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