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HEF4724B	文件：71.4 Kbytes Page：7 Pages	8-bit addressable latch DESCRIPTION The HEF4724B is an 8-bit addressable latch with three address inputs (A0 to A2), a data input (D), an active LOW enable input (E), an active HIGH clear input (CL), and eight parallel latch outputs (O0 to O7). 文件：71.4 Kbytes 页数：7 Pages	PHI 飞利浦	PHI
HEF4724BD	文件：71.4 Kbytes Page：7 Pages	8-bit addressable latch DESCRIPTION The HEF4724B is an 8-bit addressable latch with three address inputs (A0 to A2), a data input (D), an active LOW enable input (E), an active HIGH clear input (CL), and eight parallel latch outputs (O0 to O7). 文件：71.4 Kbytes 页数：7 Pages	PHI 飞利浦	PHI
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HEF4724BT	文件：71.4 Kbytes Page：7 Pages	8-bit addressable latch DESCRIPTION The HEF4724B is an 8-bit addressable latch with three address inputs (A0 to A2), a data input (D), an active LOW enable input (E), an active HIGH clear input (CL), and eight parallel latch outputs (O0 to O7). 文件：71.4 Kbytes 页数：7 Pages	PHI 飞利浦	PHI
HEF4724BD	文件：300 bytes Page：1 Pages	8-bit addressable latch DESCRIPTION\nThe HEF4724B is an 8-bit addressable latch with three address inputs (A0 to A2), a data input (D), an active LOW enable input (E), an active HIGH clear input (CL), and eight parallel latch outputs (O0 to O7).	恩XP 恩智浦	恩XP

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