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HEF4510B	文件：135.14 Kbytes Page：10 Pages	BCD up/down counter DESCRIPTION The HEF4510B is an edge-triggered synchronous up/down BCD counter with a clock input (CP), an up/down count control input (UP/DN), an active LOW count enable input (CE), an asynchronous active HIGH parallel load input (PL), four parallel inputs (P0 to P3), four parallel outputs (O0 to 文件：135.14 Kbytes 页数：10 Pages	PHI 飞利浦	PHI
HEF4510BD	文件：135.14 Kbytes Page：10 Pages	BCD up/down counter DESCRIPTION The HEF4510B is an edge-triggered synchronous up/down BCD counter with a clock input (CP), an up/down count control input (UP/DN), an active LOW count enable input (CE), an asynchronous active HIGH parallel load input (PL), four parallel inputs (P0 to P3), four parallel outputs (O0 to 文件：135.14 Kbytes 页数：10 Pages	PHI 飞利浦	PHI
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HEF4510BN	文件：135.14 Kbytes Page：10 Pages	BCD up/down counter DESCRIPTION The HEF4510B is an edge-triggered synchronous up/down BCD counter with a clock input (CP), an up/down count control input (UP/DN), an active LOW count enable input (CE), an asynchronous active HIGH parallel load input (PL), four parallel inputs (P0 to P3), four parallel outputs (O0 to 文件：135.14 Kbytes 页数：10 Pages	PHI 飞利浦	PHI
HEF4510BP	文件：135.14 Kbytes Page：10 Pages	BCD up/down counter DESCRIPTION The HEF4510B is an edge-triggered synchronous up/down BCD counter with a clock input (CP), an up/down count control input (UP/DN), an active LOW count enable input (CE), an asynchronous active HIGH parallel load input (PL), four parallel inputs (P0 to P3), four parallel outputs (O0 to 文件：135.14 Kbytes 页数：10 Pages	PHI 飞利浦	PHI
HEF4510BT	文件：135.14 Kbytes Page：10 Pages	BCD up/down counter DESCRIPTION The HEF4510B is an edge-triggered synchronous up/down BCD counter with a clock input (CP), an up/down count control input (UP/DN), an active LOW count enable input (CE), an asynchronous active HIGH parallel load input (PL), four parallel inputs (P0 to P3), four parallel outputs (O0 to 文件：135.14 Kbytes 页数：10 Pages	PHI 飞利浦	PHI
HEF4510B	文件：300 bytes Page：1 Pages	BCD up/down counter DESCRIPTION\nThe HEF4510B is an edge-triggered synchronous up/down BCD counter with a clock input (CP), an up/down count control input (UP/DN), an active LOW count enable input (CE), an asynchronous active HIGH parallel load input (PL), four parallel inputs (P0 to P3), four parallel outputs (O0 to O	恩XP	恩XP

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