2.5-V PHASE-LOCK LOOP CLOCK DRIVER

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2.5-V PHASE-LOCKED-LOOP CLOCK DRIVER

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2.5V 锁相环路 DDR 时钟驱动器

The CDCVF857 is a high-performance, low-skew, low-jitter, zero-delay buffer that distributes a differential clock input pair (CLK, CLK) to 10 differential pairs of clock outputs (Y[0:9], Y[0:9]) and one differential pair of feedback clock outputs (FBOUT, FBOUT). The clock outputs are controlled by t • Spread-Spectrum Clock Compatible\n• Low Jitter (Cycle-Cycle): ±35 ps\n• Low Jitter (Period): ±30 ps\n• Best in Class for VOX = VDD/2 ±0.1 V\n• Available in a 40-Pin MLF Package, 48-Pin TSSOP Package, 56-Ball MicroStar Junior™ BGA Package\n• Meets/Exceeds JEDEC Standard (JESD82-1) For DDRI-200/266/;

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