2.5-V PHASE-LOCK LOOP CLOCK DRIVER

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2.5-V PHASE-LOCK LOOP CLOCK DRIVER

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CDCV857B、CDCV857BI：2.5V 锁相环时钟驱动器

The CDCV857B is a high-performance, low-skew, low-jitter zero delay buffer that distributes a differential clock input pair (CLK, CLK) to 10 differential pairs of clock outputs (Y[0:9], Y[0:9]) and one differential pair of feedback clock outputs (FBOUT, FBOUT). The clock outputs are controlled by th ·Phase-Lock Loop Clock Driver for Double Data-Rate Synchronous DRAM Applications\n ·Spread Spectrum Clock Compatible\n ·Operating Frequency: 60 MHz to 200 MHz\n ·Low Jitter (cycle-cycle): ±50 ps\n ·Low Static Phase Offset: ±50 ps\n ·Low Jitter (Period): ±35 ps\n ·Distributes One Differential Clock I;

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Package：48-TFSOP（0.240"，6.10mm 宽）；包装：卷带（TR） 类别：集成电路（IC） 时钟发生器，PLL，频率合成器 描述：IC SSTL-II PLL CLK-DRVR 48-TSSOP

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Package：48-TFSOP（0.240"，6.10mm 宽）；包装：卷带（TR） 类别：集成电路（IC） 时钟发生器，PLL，频率合成器 描述：IC SSTL-II PLL CLK-DRVR 48TSSOP

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Package：48-TFSOP（0.240"，6.10mm 宽）；包装：卷带（TR） 类别：集成电路（IC） 时钟发生器，PLL，频率合成器 描述：IC SSTL-II PLL CLK-DRVR 48TSSOP

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