丝印：CDCLVD1212；Package：VQFN(RHA)；CDCLVD1212 2:12 Low Additive Jitter LVDS Buffer

1 Features 1• 2:12 Differential Buffer • Low Additive Jitter:

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丝印：CDCLVD1212；Package：VQFN(RHA)；CDCLVD1212 2:12 Low Additive Jitter LVDS Buffer

1 Features 1• 2:12 Differential Buffer • Low Additive Jitter:

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丝印：CDCLVD1212；Package：VQFN(RHA)；CDCLVD1212 2:12 Low Additive Jitter LVDS Buffer

1 Features 1• 2:12 Differential Buffer • Low Additive Jitter:

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丝印：CDCLVD1212；Package：VQFN；CDCLVD1212 2:12 Low Additive Jitter LVDS Buffer

1 Features 1• 2:12 Differential Buffer • Low Additive Jitter:

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低抖动 2 路输入可选 1:12 通用至 LVDS 缓冲器

The CDCLVD1212 clock buffer distributes one of two selectable clock inputs (IN0 and IN1) to 12 pairs of differential LVDS clock outputs (OUT0 through OUT11) with minimum skew for clock distribution. The CDCLVD1212 can accept two clock sources into an input multiplexer. The inputs can either be LVDS, • 2:12 Differential Buffer\n• Low Output Skew of 35 ps (Maximum)\n• Selectable Clock Inputs Through Control Pin\n• Clock Frequency: Up to 800 MHz\n• LVDS Reference Voltage, VAC_REF, Available for Capacitive Coupled Inputs\n• Packaged in 6-mm × 6-mm, 40-Pin VQFN (RHA)\n• ESD Protection Exceeds 3-kV H;

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CDCLVD1212 2:12 Low Additive Jitter LVDS Buffer

1 Features 1• 2:12 Differential Buffer • Low Additive Jitter:

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2:12 Low Additive Jitter LVDS Buffer

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2:12 Low Additive Jitter LVDS Buffer

文件：707.95 Kbytes 页数：20 Pages

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包装：散装 功能：时钟缓冲器/驱动器/接收器/转换器 类别：开发板，套件，编程器 评估和演示板及套件 描述：EVAL MODULE FOR CDCLVD1212

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Package：40-VFQFN 裸露焊盘；包装：卷带（TR）剪切带（CT）Digi-Reel® 得捷定制卷带 类别：集成电路（IC） 时钟缓冲器，驱动器 描述：IC CLK BUFFER 2:12 800MHZ 40VQFN

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