1Line to 6Line Clock Driver

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具有可选择极性的 1 至 6 CMOS 时钟驱动器

The CDC329A contains a clock-driver circuit that distributes one input signal to six outputs with minimum skew for clock distribution. Through the use of the polarity-control inputs (T\\/C), various combinations of true and complementary outputs can be obtained. The CDC329A is characterized for oper • Low Output Skew for Clock-Distribution and Clock-Generation Applications\n• TTL-Compatible Inputs and CMOS-Compatible Outputs\n• Distributes One Clock Input to Six Clock Outputs \n• Polarity Control Selects True or Complementary Outputs \n• Distributed VCC and GND Pins Reduce Switching Noise \n• H;

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Package：16-SOIC（0.154"，3.90mm 宽）；包装：托盘 类别：集成电路（IC） 时钟缓冲器，驱动器 描述：IC CLK BUFFER 1:6 80MHZ 16SOIC

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Package：16-SOIC（0.154"，3.90mm 宽）；包装：卷带（TR） 类别：集成电路（IC） 时钟缓冲器，驱动器 描述：IC CLK BUFFER 1:6 80MHZ 16SOIC

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Package：16-SOIC（0.154"，3.90mm 宽）；包装：卷带（TR） 类别：集成电路（IC） 时钟缓冲器，驱动器 描述：IC CLK BUFFER 1:6 80MHZ 16SOIC

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