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74F113	文件：59.83 Kbytes Page：6 Pages	Dual JK Negative Edge-Triggered Flip-Flop General Description The 74F113 offers individual J, K, Set and Clock inputs. When the clock goes HIGH the inputs are enabled and data may be entered. The logic level of the J and K inputs may be changed when the clock pulse is HIGH and the flipflop will perform according to the Truth Table as lo 文件：59.83 Kbytes 页数：6 Pages	FAIRCHILD 仙童半导体	FAIRCHILD
74F113	文件：81.65 Kbytes Page：10 Pages	Dual J-K negative edge-triggered flip-flops without reset DESCRIPTION The 74F113, dual negative edge-triggered JK-type flip-flop, features individual J, K, clock (CP), set (SD) inputs, true and complementary outputs. The asynchronous SD input, when low, forces the outputs to the steady state levels as shown in the function table regardless of the level 文件：81.65 Kbytes 页数：10 Pages	PHI PHI	PHI
74F113	文件：300 bytes Page：1 Pages	Dual JK Negative Edge-Triggered Flip-Flop	ONSEMI 安森美半导体	ONSEMI
74F113PC	文件：59.83 Kbytes Page：6 Pages	Dual JK Negative Edge-Triggered Flip-Flop General Description The 74F113 offers individual J, K, Set and Clock inputs. When the clock goes HIGH the inputs are enabled and data may be entered. The logic level of the J and K inputs may be changed when the clock pulse is HIGH and the flipflop will perform according to the Truth Table as lo 文件：59.83 Kbytes 页数：6 Pages	FAIRCHILD 仙童半导体	FAIRCHILD
74F113SC	文件：59.83 Kbytes Page：6 Pages	Dual JK Negative Edge-Triggered Flip-Flop General Description The 74F113 offers individual J, K, Set and Clock inputs. When the clock goes HIGH the inputs are enabled and data may be entered. The logic level of the J and K inputs may be changed when the clock pulse is HIGH and the flipflop will perform according to the Truth Table as lo 文件：59.83 Kbytes 页数：6 Pages	FAIRCHILD 仙童半导体	FAIRCHILD
74F113SJ	文件：59.83 Kbytes Page：6 Pages	Dual JK Negative Edge-Triggered Flip-Flop General Description The 74F113 offers individual J, K, Set and Clock inputs. When the clock goes HIGH the inputs are enabled and data may be entered. The logic level of the J and K inputs may be changed when the clock pulse is HIGH and the flipflop will perform according to the Truth Table as lo 文件：59.83 Kbytes 页数：6 Pages	FAIRCHILD 仙童半导体	FAIRCHILD
74F113PC	文件：100 bytes Page：1 Pages	Package：14-DIP（0.300"，7.62mm）；包装：袋功能：设置（预设）和复位类别：集成电路（IC）触发器描述：IC FF JK TYPE DUAL 1BIT 14DIP	ONSEMI 安森美半导体	ONSEMI

详细参数

型号：
74F113
功能描述：
触发器 Dual J-K Flip-Flop
RoHS：
否
制造商：
Texas Instruments
电路数量：
2
逻辑系列：
SN74
逻辑类型：
D-Type Flip-Flop
极性：
Inverting, Non-Inverting
输入类型：
CMOS
传播延迟时间：
4.4 ns
高电平输出电流：
- 16 mA
低电平输出电流：
16 mA
电源电压-最大：
5.5 V
最大工作温度：
+ 85 C
安装风格：
SMD/SMT
封装/箱体：
X2SON-8
封装：
Reel

供应商	型号	品牌	批号	封装	库存	备注	价格
深圳市一线半导体有限公司	74F113	NATIONAL	24+	SMD-14	500		询价
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