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74F113	文件：81.65 Kbytes Page：10 Pages	DualJ-Knegativeedge-triggeredflip-flopswithoutreset DESCRIPTION The74F113,dualnegativeedge-triggeredJK-typeflip-flop,featuresindividualJ,K,clock(CP),set(SD)inputs,trueandcomplementaryoutputs.TheasynchronousSDinput,whenlow,forcestheoutputstothesteadystatelevelsasshowninthefunctiontableregardlessofthelevel	PhilipsROYAL PHILIPS 飞利浦荷兰皇家飞利浦	Philips
74F113	文件：59.83 Kbytes Page：6 Pages	DualJKNegativeEdge-TriggeredFlip-Flop GeneralDescription The74F113offersindividualJ,K,SetandClockinputs.WhentheclockgoesHIGHtheinputsareenabledanddatamaybeentered. ThelogicleveloftheJandKinputsmaybechangedwhentheclockpulseisHIGHandtheflipflopwillperformaccordingtotheTruthTableaslo	FairchildFairchild Semiconductor 仙童半导体飞兆/仙童半导体公司	Fairchild
74F113PC	文件：59.83 Kbytes Page：6 Pages	DualJKNegativeEdge-TriggeredFlip-Flop GeneralDescription The74F113offersindividualJ,K,SetandClockinputs.WhentheclockgoesHIGHtheinputsareenabledanddatamaybeentered. ThelogicleveloftheJandKinputsmaybechangedwhentheclockpulseisHIGHandtheflipflopwillperformaccordingtotheTruthTableaslo	FairchildFairchild Semiconductor 仙童半导体飞兆/仙童半导体公司	Fairchild
74F113SC	文件：59.83 Kbytes Page：6 Pages	DualJKNegativeEdge-TriggeredFlip-Flop GeneralDescription The74F113offersindividualJ,K,SetandClockinputs.WhentheclockgoesHIGHtheinputsareenabledanddatamaybeentered. ThelogicleveloftheJandKinputsmaybechangedwhentheclockpulseisHIGHandtheflipflopwillperformaccordingtotheTruthTableaslo	FairchildFairchild Semiconductor 仙童半导体飞兆/仙童半导体公司	Fairchild
74F113SJ	文件：59.83 Kbytes Page：6 Pages	DualJKNegativeEdge-TriggeredFlip-Flop GeneralDescription The74F113offersindividualJ,K,SetandClockinputs.WhentheclockgoesHIGHtheinputsareenabledanddatamaybeentered. ThelogicleveloftheJandKinputsmaybechangedwhentheclockpulseisHIGHandtheflipflopwillperformaccordingtotheTruthTableaslo	FairchildFairchild Semiconductor 仙童半导体飞兆/仙童半导体公司	Fairchild
I74F113D	文件：81.65 Kbytes Page：10 Pages	DualJ-Knegativeedge-triggeredflip-flopswithoutreset DESCRIPTION The74F113,dualnegativeedge-triggeredJK-typeflip-flop,featuresindividualJ,K,clock(CP),set(SD)inputs,trueandcomplementaryoutputs.TheasynchronousSDinput,whenlow,forcestheoutputstothesteadystatelevelsasshowninthefunctiontableregardlessofthelevel	PhilipsROYAL PHILIPS 飞利浦荷兰皇家飞利浦	Philips
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N74F113D	文件：81.65 Kbytes Page：10 Pages	DualJ-Knegativeedge-triggeredflip-flopswithoutreset DESCRIPTION The74F113,dualnegativeedge-triggeredJK-typeflip-flop,featuresindividualJ,K,clock(CP),set(SD)inputs,trueandcomplementaryoutputs.TheasynchronousSDinput,whenlow,forcestheoutputstothesteadystatelevelsasshowninthefunctiontableregardlessofthelevel	PhilipsROYAL PHILIPS 飞利浦荷兰皇家飞利浦	Philips
N74F113N	文件：81.65 Kbytes Page：10 Pages	DualJ-Knegativeedge-triggeredflip-flopswithoutreset DESCRIPTION The74F113,dualnegativeedge-triggeredJK-typeflip-flop,featuresindividualJ,K,clock(CP),set(SD)inputs,trueandcomplementaryoutputs.TheasynchronousSDinput,whenlow,forcestheoutputstothesteadystatelevelsasshowninthefunctiontableregardlessofthelevel	PhilipsROYAL PHILIPS 飞利浦荷兰皇家飞利浦	Philips

详细参数

型号：
74F113SJX
功能描述：
触发器 Dual J-K Flip-Flop
RoHS：
否
制造商：
Texas Instruments
电路数量：
2
逻辑系列：
SN74
逻辑类型：
D-Type Flip-Flop
极性：
Inverting, Non-Inverting
输入类型：
CMOS
传播延迟时间：
4.4 ns
高电平输出电流：
- 16 mA
低电平输出电流：
16 mA
电源电压-最大：
5.5 V
最大工作温度：
+ 85 C
安装风格：
SMD/SMT
封装/箱体：
X2SON-8
封装：
Reel

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