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74ALS112	文件：92.64 Kbytes Page：10 Pages	Dual J-K negative edge-triggered flip-flop DESCRIPTION The 74ALS112A, dual negative edge-triggered JK-type flip-flop features individual J, K, clock (CPn), set (SD), and reset (RD) inputs, true (Qn) and complementary (Qn) outputs. The SD and RD inputs, when Low, set or reset the outputs as shown in the function table regardless of th 文件：92.64 Kbytes 页数：10 Pages	PHI 飞利浦	PHI
74ALS112A	文件：92.64 Kbytes Page：10 Pages	Dual J-K negative edge-triggered flip-flop DESCRIPTION The 74ALS112A, dual negative edge-triggered JK-type flip-flop features individual J, K, clock (CPn), set (SD), and reset (RD) inputs, true (Qn) and complementary (Qn) outputs. The SD and RD inputs, when Low, set or reset the outputs as shown in the function table regardless of th 文件：92.64 Kbytes 页数：10 Pages	PHI 飞利浦	PHI
74ALS112AD	文件：92.64 Kbytes Page：10 Pages	Dual J-K negative edge-triggered flip-flop DESCRIPTION The 74ALS112A, dual negative edge-triggered JK-type flip-flop features individual J, K, clock (CPn), set (SD), and reset (RD) inputs, true (Qn) and complementary (Qn) outputs. The SD and RD inputs, when Low, set or reset the outputs as shown in the function table regardless of th 文件：92.64 Kbytes 页数：10 Pages	PHI 飞利浦	PHI
74ALS112AN	文件：92.64 Kbytes Page：10 Pages	Dual J-K negative edge-triggered flip-flop DESCRIPTION The 74ALS112A, dual negative edge-triggered JK-type flip-flop features individual J, K, clock (CPn), set (SD), and reset (RD) inputs, true (Qn) and complementary (Qn) outputs. The SD and RD inputs, when Low, set or reset the outputs as shown in the function table regardless of th 文件：92.64 Kbytes 页数：10 Pages	PHI 飞利浦	PHI

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