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丝印:73034AIL;Package:TSSOP;Low Skew, ÷2, ÷4, ÷8 Differential-to-LVPECL Clock Divider Features • ÷2, ÷4 and ÷8 clock frequency divider • Three differential LVPECL output pairs • One differential PCLK, nPCLK input pair • PCLK, nPCLK pair can accept the following differential input levels: LVPECL, LVDS, CML • VBB bias voltage generator supports single-ended LVPECL clock input 文件:1.08092 Mbytes 页数:21 Pages | RENESAS 瑞萨 | RENESAS | ||
丝印:73034AIL;Package:TSSOP;Low Skew, ÷2, ÷4, ÷8 Differential-to-LVPECL Clock Divider Features • ÷2, ÷4 and ÷8 clock frequency divider • Three differential LVPECL output pairs • One differential PCLK, nPCLK input pair • PCLK, nPCLK pair can accept the following differential input levels: LVPECL, LVDS, CML • VBB bias voltage generator supports single-ended LVPECL clock input 文件:1.08092 Mbytes 页数:21 Pages | RENESAS 瑞萨 | RENESAS |
供应商 | 型号 | 品牌 | 批号 | 封装 | 库存 | 备注 | 价格 |
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