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1.1G-BIT Lo w Latency DRAM-III Common I/O Burst Length of 4

Features •2cycle800MHzDDRMuxedAddress •OptionaldatabusinversiontoreduceSSO,SSN,maximumI/Ocurrent,andaverageI/Opower •Trainingsequenceforper-bitdeskew •SelectableRefreshMode:AutoorOverlappedRefresh •ProgrammablePVT-compensatedoutputimpedance •Programmable

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