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UPD48011418FF-FH12-FF1-A	文件：1.19876 Mbytes Page：51 Pages	1.1G-BIT Lo w Latency DRAM-III Common I/O Burst Length of 4 Features • 2 cycle 800MHz DDR Muxed Address • Optional data bus inversion to reduce SSO, SSN, maximum I/O current, and average I/O power • Training sequence for per-bit deskew • Selectable Refresh Mode: Auto or Overlapped Refresh • Programmable PVT-compensated output impedance • Programmable 文件：1.19876 Mbytes 页数：51 Pages	RENESAS 瑞萨	RENESAS
UPD48011418FF-FH12-FF1-A	文件：300 bytes Page：1 Pages	Memory-Low Latency DRAM	Renesas 瑞萨	Renesas
UPD5713TK-E2-A	文件：0 bytes Page：0 Pages	RENESAS SOT563	RENESAS 瑞萨上传：深圳市正纳电子有限公司	RENESAS
UPD5716GR-E1-A	文件：0 bytes Page：0 Pages	RENESAS HTSSOT16	RENESAS 瑞萨上传：深圳市正纳电子有限公司	RENESAS
UPD5739T7A-E1-A	文件：0 bytes Page：0 Pages	RENESAS HTSSOP16	RENESAS 瑞萨上传：深圳市正纳电子有限公司	RENESAS

技术参数

Supply voltage (V)：
1.5
Density (Mbits)：
1100
Architecture：
Low Latency DRAM-III
Function：
Common I/O
Burst Length (words)：
4
Data Width (bits)：
18
MAX Frequency (MHz)：
800
MIN Frequency (MHz)：
400
tRC (ns)：
13.75
Operation Temp (degC)：
Tc=-0 to 95
I/O Voltage (V)：
1
Production Status：
EOL announced

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更多UPD48011418FF-FH12-FF1-A供应商更新时间2025-10-4 15:01:00

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