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PLL102-05SC-R	文件：222.99 Kbytes Page：6 Pages	Low Skew Output Buffer DESCRIPTION The PLL102-05 is a high performance, low skew, low jitter zero delay buffer designed to distribute high speed clocks and is available in 8-pin SOIC package. It has four outputs that are synchronized with the input. The synchronization is established via CLKOUT feed back to the input o 文件：222.99 Kbytes 页数：6 Pages	PLL	PLL
TMM-102-05-G-S-SM	文件：153.43 Kbytes Page：1 Pages	2MM TERMINAL STRIP ASSEMBLY 文件：153.43 Kbytes 页数：1 Pages	Samtec 美国申泰	Samtec
TMM-102-05-I-S-SM	文件：153.43 Kbytes Page：1 Pages	2MM TERMINAL STRIP ASSEMBLY 文件：153.43 Kbytes 页数：1 Pages	Samtec 美国申泰	Samtec
BISL-102-05/L	文件：105.12 Kbytes Page：2 Pages	LF (125 kHz) 文件：105.12 Kbytes 页数：2 Pages	Balluff 巴鲁夫	Balluff
BISL-102-05/L-RO	文件：105.25 Kbytes Page：2 Pages	LF (125 kHz) 文件：105.25 Kbytes 页数：2 Pages	Balluff 巴鲁夫	Balluff
BISL-102-05SLASHL	文件：105.12 Kbytes Page：2 Pages	LF (125 kHz) 文件：105.12 Kbytes 页数：2 Pages	Balluff 巴鲁夫	Balluff

更多PLL102-05SC-R供应商更新时间2025-10-4 16:01:00