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NT5CC512M8EN-DIT规格书详情
Basis DDR3 Compliant
-8n Prefetch Architecture
-Differential C lock ( and Data Strobe(DQS/
-Double data rate on DQs, DQS and DM
Data Integrity
-Auto Self Refresh ( A SR) by DRAM built in T S
-Auto Refresh and Self Refresh Mode s
Power Saving Mode
-Power Down Mode
Signal Integrity
-Configurable DS for system compatibility
-Configurable On Die Termination
-ZQ Calibration for DS/ODT impedance accuracy via
external ZQ pad (240 ohm 1)
Signal Synchronization
-Write Leveling via MR settings 5
-Read Leveling via MPR
Interface and Power Supply
-SSTL_15 for DDR3:VDD/VDDQ= 1.5V ((±0.075V
-SSTL_135 2 for DDR3L:V DD/VDDQ= 1.35V 0.067/+0.1V
| 供应商 | 型号 | 品牌 | 批号 | 封装 | 库存 | 备注 | 价格 |
|---|---|---|---|---|---|---|---|
Nanya(南亚科技) |
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NANYA/南亚 |
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NA/ |
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BGA |
80000 |
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NANYA/南亚 |
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BGA |
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NANYA |
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NANYA/南亚 |
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BGA78 |
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