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MK2049-01SI	文件：137.06 Kbytes Page：11 Pages	Communications Clock PLL Description TheMK2049isaPhase-LockedLoop(PLL)basedclocksynthesizer,whichacceptsan8kHzclockinputasareferenceandgeneratesT1,E1,T3,E3,andOC3frequencies.ThedevicecanalsoacceptaT1,E1,T3,orE3inputclockandprovidethesameoutputforlooptiming.Alloutputsare	ICST Integrated Circuit Systems
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