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IDT74SSTUBF32865ABKG8	文件：422.3 Kbytes Page：17 Pages	28-BIT 1:2 REGISTERED BUFFER WITH PARITY Description This 28-bit 1:2 registered buffer with parity is designed for 1.7V to 1.9V VDD operation. All clock and data inputs are compatible with the JEDEC standard for SSTL_18. The control inputs are LVCMOS. All outputs are 1.8 V CMOS drivers that have been optimized to drive the DDR2 DIMM lo 文件：422.3 Kbytes 页数：17 Pages	IDT	IDT
IDT74SSTUBF32865ABKG8	文件：600.42 Kbytes Page：17 Pages	28-BIT 1:2 REGISTERED BUFFER WITH PARITY Features • 28-bit 1:2 registered buffer with parity check functionality • Supports SSTL_18 JEDEC specification on data inputs and outputs • Supports LVCMOS switching levels on CSGateEN and RESET inputs • Low voltage operation: VDD = 1.7V to 1.9V • Available in 160-ball LFBGA package Applic 文件：600.42 Kbytes 页数：17 Pages	RENESAS 瑞萨	RENESAS
IDT74SSTUBF32865A	文件：600.42 Kbytes Page：17 Pages	28-BIT 1:2 REGISTERED BUFFER WITH PARITY Features • 28-bit 1:2 registered buffer with parity check functionality • Supports SSTL_18 JEDEC specification on data inputs and outputs • Supports LVCMOS switching levels on CSGateEN and RESET inputs • Low voltage operation: VDD = 1.7V to 1.9V • Available in 160-ball LFBGA package Applic 文件：600.42 Kbytes 页数：17 Pages	RENESAS 瑞萨	RENESAS
IDT74SSTUBF32865A	文件：422.3 Kbytes Page：17 Pages	28-BIT 1:2 REGISTERED BUFFER WITH PARITY Description This 28-bit 1:2 registered buffer with parity is designed for 1.7V to 1.9V VDD operation. All clock and data inputs are compatible with the JEDEC standard for SSTL_18. The control inputs are LVCMOS. All outputs are 1.8 V CMOS drivers that have been optimized to drive the DDR2 DIMM lo 文件：422.3 Kbytes 页数：17 Pages	IDT	IDT

详细参数

型号：
IDT74SSTUBF32865ABKG
功能描述：
IC BUFFER 28BIT
1：
2 REG 160-BGA
RoHS：
是
类别：
集成电路(IC) >> 逻辑 - 专用逻辑
系列：
-
产品变化通告：
Product Discontinuation 25/Apr/2012
标准包装：
1,500
系列：
74SSTV
逻辑类型：
DDR 的寄存缓冲器
电源电压：
2.3 V ~ 2.7 V
位数：
14
工作温度：
0°C ~ 70°C
安装类型：
表面贴装
封装/外壳：
48-TFSOP（0.240，6.10mm 宽）
供应商设备封装：
48-TSSOP
包装：
带卷(TR)

供应商	型号	品牌	批号	封装	库存	备注	价格
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