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EP1C4	文件：1.35316 Mbytes Page：104 Pages	Cyclone FPGA Family Data Sheet Introduction The Cyclone® field programmable gate array family is based on a 1.5-V, 0.13-μm, all-layer copper SRAM process, with densities up to 20,060 logic elements (LEs) and up to 288 Kbits of RAM. With features like phase-locked loops (PLLs) for clocking and a dedicated double data rate (DDR) 文件：1.35316 Mbytes 页数：104 Pages	Altera 阿尔特	Altera
EP1C4	文件：456.96 Kbytes Page：34 Pages	1. Enhanced Configuration Devices (EPC4, EPC8, and EPC16) Data Sheet The Altera enhanced configuration device is a single-device, high-speed, advanced configuration solution for very high-density FPGAs. The core of an enhanced configuration device is divided into two major blocks, a configuration controller and a flash memory. The flash memory is used to store conf 文件：456.96 Kbytes 页数：34 Pages	Altera 阿尔特	Altera
EP1C4	文件：1.14233 Mbytes Page：94 Pages	Cyclone FPGA Family 文件：1.14233 Mbytes 页数：94 Pages	Altera 阿尔特	Altera
EP1C4	文件：2.063429 Mbytes Page：182 Pages	Package Information Datasheet for Mature Altera Devices 文件：2.063429 Mbytes 页数：182 Pages	Altera 阿尔特	Altera
EP1C4	文件：621.91 Kbytes Page：36 Pages	This datasheet describes enhanced configuration (EPC) devices 文件：621.91 Kbytes 页数：36 Pages	Altera 阿尔特	Altera
EP1C4	文件：2.06334 Mbytes Page：182 Pages	Package Information Datasheet for Mature Altera Devices 文件：2.06334 Mbytes 页数：182 Pages	Altera 阿尔特	Altera
EP1C4	文件：633.77 Kbytes Page：36 Pages	Enhanced Configuration (EPC) Devices Datasheet 文件：633.77 Kbytes 页数：36 Pages	Altera 阿尔特	Altera
EP1C4	文件：5.60108 Mbytes Page：385 Pages	Cyclone Device Handbook, Volume 1 文件：5.60108 Mbytes 页数：385 Pages	etc2List of Unclassifed Manufacturers etc未分类制造商etc2未分类制造商	etc2
EP1C4F100C6ES	文件：1.35316 Mbytes Page：104 Pages	Cyclone FPGA Family Data Sheet Introduction The Cyclone® field programmable gate array family is based on a 1.5-V, 0.13-μm, all-layer copper SRAM process, with densities up to 20,060 logic elements (LEs) and up to 288 Kbits of RAM. With features like phase-locked loops (PLLs) for clocking and a dedicated double data rate (DDR) 文件：1.35316 Mbytes 页数：104 Pages	Altera 阿尔特	Altera
EP1C4F100C7ES	文件：1.35316 Mbytes Page：104 Pages	Cyclone FPGA Family Data Sheet Introduction The Cyclone® field programmable gate array family is based on a 1.5-V, 0.13-μm, all-layer copper SRAM process, with densities up to 20,060 logic elements (LEs) and up to 288 Kbits of RAM. With features like phase-locked loops (PLLs) for clocking and a dedicated double data rate (DDR) 文件：1.35316 Mbytes 页数：104 Pages	Altera 阿尔特	Altera

详细参数

型号：
EP1C4
功能描述：
FPGA - 现场可编程门阵列 FPGA - Cyclone I 400 LABs 249 IOs
RoHS：
否
制造商：
Altera Corporation
系列：
Cyclone V E
逻辑块数量：
943 内嵌式块RAM -
EBR：
1956 kbit
输入/输出端数量：
128
最大工作频率：
800 MHz
工作电源电压：
1.1 V
最大工作温度：
+ 70 C
安装风格：
SMD/SMT
封装/箱体：
FBGA-256

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