PSoC 6 MCU: CY8C61x5 Datasheet

Features Note: In PSoC 61 the Cortex M0+ is reserved for system functions, and is not available for applications. 32-bit Dual CPU Subsystem ■ 150-MHz Arm® Cortex®-M4F (CM4) CPU with single-cycle multiply, floating point, and memory protection unit (MPU) ■ 100-MHz Cortex-M0+ (CM0+) CPU with s

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BGA-124

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