Package：28-TSSOP（0.173"，4.40mm 宽）；包装：卷带（TR） 类别：集成电路（IC） 应用特定时钟/定时 描述：IC CLK BUF DDR 600MHZ 1CIRC

Renesas Electronics America Inc

Package：28-TSSOP（0.173"，4.40mm 宽）；包装：卷带（TR） 类别：集成电路（IC） 应用特定时钟/定时 描述：IC CLK BUF DDR 600MHZ 1CIRC

Renesas Electronics America Inc

DDR I/DDR II Phase Lock Loop Zero Delay Buffer

Description Output Features DDR I/DDR II Zero Delay Clock Buffer • Low skew, low jitter PLL clock driver • Max frequency supported = 400MHz (DDRII 800) • I2C for functional and output control • Feedback pins for input to output synchronization • Spread Spectrum tolerant inputs • Programmab

文件：330.22 Kbytes 页数：14 Pages

RENESAS

瑞萨

DDR I/DDR II Phase Lock Loop Zero Delay Buffer

文件：197.41 Kbytes 页数：13 Pages

IDT

DDR I/DDR II Phase Lock Loop Zero Delay Buffer

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IDT