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74AC11032DBR.A	文件：1.23403 Mbytes Page：28 Pages	丝印：AE032；Package：SSOP；QUADRUPLE 2-INPUT POSITIVE-OR GATE Center-Pin VCC and GND Configurations Minimize High-Speed Switching Noise EPICE (Enhanced-Performance Implanted CMOS) 1-mm Process 500-mA Typical Latch-Up Immunity at 125°C Package Options Include Plastic Small-Outline (D) and Shrink Small-Outline (DB) Packages, and Standard Plastic 300-m 文件：1.23403 Mbytes 页数：28 Pages	TI 德州仪器	TI
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更多74AC11032DBR.A供应商更新时间2026-1-30 15:14:00