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SY10E195JCTR

PROGRAMMABLE DELAY CHIP

DESCRIPTION The SY10/100E195 are programmable delay chips (PDCs) designed primarily for clock de-skewing and timing adjustment. They provide variable delay of a differential ECL input transition. The delay section consists of a chain of gates organized as shown in the logic diagram. The first tw

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麦瑞半导体

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更多SY10E195JCTR供应商 更新时间2025-10-8 16:21:00