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SI53119	文件：1.35162 Mbytes Page：35 Pages	19-OUTPUT PCIE GEN 3 BUFFER Features  Nineteen 0.7 V low-power, pushpull HCSL PCIe Gen 3 outputs  100 MHz /133 MHz PLL operation, supports PCIe and QPI  PLL bandwidth SW SMBUS programming overrides the latch value from HW pin  9 selectable SMBUS addresses  SMBus address configurable to allow multiple buffers 文件：1.35162 Mbytes 页数：35 Pages	SKYWORKS 思佳讯	SKYWORKS
SI53119	文件：1.42694 Mbytes Page：35 Pages	19-OUTPUT PCIE GEN 3 BUFFER 文件：1.42694 Mbytes 页数：35 Pages	SILABS 芯科科技	SILABS
Si53119	文件：300 bytes Page：1 Pages	PCIe Fanout/Zero-Delay Buffer The Si53119 is a 1 : 19 PCIe Fanout/Zero-Delay Buffer that meets all of the performance requirements of the Intel DB1900Z specification. The device is optimized for distributing 19 reference clocks for Intel® QuickPath Interconnect (Intel QPI), PCIe Gen 1/Gen 2/ Gen 3, SAS, SATA and Intel Scalable	Skyworks 思佳讯	Skyworks
SI53119-A01AGM	文件：1.35162 Mbytes Page：35 Pages	19-OUTPUT PCIE GEN 3 BUFFER Features  Nineteen 0.7 V low-power, pushpull HCSL PCIe Gen 3 outputs  100 MHz /133 MHz PLL operation, supports PCIe and QPI  PLL bandwidth SW SMBUS programming overrides the latch value from HW pin  9 selectable SMBUS addresses  SMBus address configurable to allow multiple buffers 文件：1.35162 Mbytes 页数：35 Pages	SKYWORKS 思佳讯	SKYWORKS
SI53119-A01AGMR	文件：1.35162 Mbytes Page：35 Pages	19-OUTPUT PCIE GEN 3 BUFFER Features  Nineteen 0.7 V low-power, pushpull HCSL PCIe Gen 3 outputs  100 MHz /133 MHz PLL operation, supports PCIe and QPI  PLL bandwidth SW SMBUS programming overrides the latch value from HW pin  9 selectable SMBUS addresses  SMBus address configurable to allow multiple buffers 文件：1.35162 Mbytes 页数：35 Pages	SKYWORKS 思佳讯	SKYWORKS
SI53119-A03A	文件：1.35006 Mbytes Page：35 Pages	19-OUTPUT PCIE GEN 3 BUFFER Features  Nineteen 0.7 V low-power, pushpull HCSL PCIe Gen 3 outputs  100 MHz /133 MHz PLL operation, supports PCIe and QPI  PLL bandwidth SW SMBUS programming overrides the latch value from HW pin  9 selectable SMBUS addresses  SMBus address configurable to allow multiple buffers 文件：1.35006 Mbytes 页数：35 Pages	SKYWORKS 思佳讯	SKYWORKS
SI53119-A03AGM	文件：1.35006 Mbytes Page：35 Pages	19-OUTPUT PCIE GEN 3 BUFFER Features  Nineteen 0.7 V low-power, pushpull HCSL PCIe Gen 3 outputs  100 MHz /133 MHz PLL operation, supports PCIe and QPI  PLL bandwidth SW SMBUS programming overrides the latch value from HW pin  9 selectable SMBUS addresses  SMBus address configurable to allow multiple buffers 文件：1.35006 Mbytes 页数：35 Pages	SKYWORKS 思佳讯	SKYWORKS
SI53119-A03AGMR	文件：1.35006 Mbytes Page：35 Pages	19-OUTPUT PCIE GEN 3 BUFFER Features  Nineteen 0.7 V low-power, pushpull HCSL PCIe Gen 3 outputs  100 MHz /133 MHz PLL operation, supports PCIe and QPI  PLL bandwidth SW SMBUS programming overrides the latch value from HW pin  9 selectable SMBUS addresses  SMBus address configurable to allow multiple buffers 文件：1.35006 Mbytes 页数：35 Pages	SKYWORKS 思佳讯	SKYWORKS
SI53119-A03A	文件：1.4135 Mbytes Page：34 Pages	PLL or bypass mode 文件：1.4135 Mbytes 页数：34 Pages	SILABS 芯科科技	SILABS
Si53119-A03AGM	文件：1.4135 Mbytes Page：34 Pages	PLL or bypass mode 文件：1.4135 Mbytes 页数：34 Pages	SILABS 芯科科技	SILABS

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技术参数

Temperature Range Min (°C)：
-40
Package Type：
QFN72
OPN：
Si53119-A01AGM
Line Impedance Match：
0
Universal Buffers：
false
Number of Inputs：
1
Number of Outputs：
19
Frequency Max：
133
Frequency Min (MHz)：
100
Package Size (mm)：
10x10
Description：
PCle Fan-out/Zero-Delay Buffer
Ouput Format(s)：
HCSL
VDDO (V)：
3.3
Additive Jitter (ps RMS)：
0.08
VDD (V)：
3.3
PCIe Compliant：
true
Feedback Path：
false
Output Format Categories：
Differential
Single Ended Input：
false
LVCMOS Buffers：
false
Differential Buffers：
false
Dual：
false
Temperature Range Max (°C)：
85
Zero Delay Buffers：
true

供应商	型号	品牌	批号	封装	库存	备注	价格
贸泽芯城（深圳）电子科技有限公司	SI53119	SILICON LABS/芯科	23+	QFN	3000	一级代理原厂VIP渠道,专注军工、汽车、医疗、工业、	询价
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技术参数

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