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74F114SC	文件：55.22 Kbytes Page：6 Pages	Dual JK Negative Edge-Triggered Flip-Flop with Common Clocks and Clears GeneralDescription The74F114containstwohigh-speedJKflip-flopswithcommonClockandClearinputs.Synchronousstatechangesareinitiatedbythefallingedgeoftheclock.Triggeringoccursatavoltageleveloftheclockandisnotdirectlyrelatedtothetransitiontime.TheJandKinp	FairchildFairchild Semiconductor 仙童半导体飞兆/仙童半导体公司	Fairchild
74F114	文件：55.22 Kbytes Page：6 Pages	DualJKNegativeEdge-TriggeredFlip-FlopwithCommonClocksandClears GeneralDescription The74F114containstwohigh-speedJKflip-flopswithcommonClockandClearinputs.Synchronousstatechangesareinitiatedbythefallingedgeoftheclock.Triggeringoccursatavoltageleveloftheclockandisnotdirectlyrelatedtothetransitiontime.TheJandKinp	FairchildFairchild Semiconductor 仙童半导体飞兆/仙童半导体公司	Fairchild
74F114	文件：51.33 Kbytes Page：6 Pages	DualJ-Knegativeedge-triggeredflip-flopwithcommonclockandreset DESCRIPTION The74F114,DualNegativeedge-triggeredJK-TypeFlip-Flopwithcommonclockandresetinputs,featuresindividualJ,K,Clock(CP),Set(SD)andReset(RD)inputs,trueandcomplementaryoutputs.TheSDandRDinputs,whenLow,setorresettheoutputsasshownintheFunctionTable	PhilipsROYAL PHILIPS 飞利浦荷兰皇家飞利浦	Philips
74F114PC	文件：55.22 Kbytes Page：6 Pages	DualJKNegativeEdge-TriggeredFlip-FlopwithCommonClocksandClears GeneralDescription The74F114containstwohigh-speedJKflip-flopswithcommonClockandClearinputs.Synchronousstatechangesareinitiatedbythefallingedgeoftheclock.Triggeringoccursatavoltageleveloftheclockandisnotdirectlyrelatedtothetransitiontime.TheJandKinp	FairchildFairchild Semiconductor 仙童半导体飞兆/仙童半导体公司	Fairchild
N74F114D	文件：51.33 Kbytes Page：6 Pages	DualJ-Knegativeedge-triggeredflip-flopwithcommonclockandreset DESCRIPTION The74F114,DualNegativeedge-triggeredJK-TypeFlip-Flopwithcommonclockandresetinputs,featuresindividualJ,K,Clock(CP),Set(SD)andReset(RD)inputs,trueandcomplementaryoutputs.TheSDandRDinputs,whenLow,setorresettheoutputsasshownintheFunctionTable	PhilipsROYAL PHILIPS 飞利浦荷兰皇家飞利浦	Philips
N74F114N	文件：51.33 Kbytes Page：6 Pages	DualJ-Knegativeedge-triggeredflip-flopwithcommonclockandreset DESCRIPTION The74F114,DualNegativeedge-triggeredJK-TypeFlip-Flopwithcommonclockandresetinputs,featuresindividualJ,K,Clock(CP),Set(SD)andReset(RD)inputs,trueandcomplementaryoutputs.TheSDandRDinputs,whenLow,setorresettheoutputsasshownintheFunctionTable	PhilipsROYAL PHILIPS 飞利浦荷兰皇家飞利浦	Philips

详细参数

型号：
74F114SC
功能描述：
触发器 Dual J-K Flip-Flop
RoHS：
否
制造商：
Texas Instruments
电路数量：
2
逻辑系列：
SN74
逻辑类型：
D-Type Flip-Flop
极性：
Inverting, Non-Inverting
输入类型：
CMOS
传播延迟时间：
4.4 ns
高电平输出电流：
- 16 mA
低电平输出电流：
16 mA
电源电压-最大：
5.5 V
最大工作温度：
+ 85 C
安装风格：
SMD/SMT
封装/箱体：
X2SON-8
封装：
Reel

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